[实用新型]检测合并单元测试仪角差分辨率的装置有效
申请号: | 201621235587.5 | 申请日: | 2016-11-17 |
公开(公告)号: | CN206223955U | 公开(公告)日: | 2017-06-06 |
发明(设计)人: | 姚艳松 | 申请(专利权)人: | 南京丹迪克科技开发有限公司 |
主分类号: | G01R35/00 | 分类号: | G01R35/00 |
代理公司: | 常州佰业腾飞专利代理事务所(普通合伙)32231 | 代理人: | 康潇 |
地址: | 210049 江苏省*** | 国省代码: | 江苏;32 |
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摘要: | 本实用新型涉及电力系统测试技术领域,尤其是一种检测合并单元测试仪角差分辨率的装置,包括同步装置、同步模块、AD采样模块、数字调相模块、控制单元和以太网控制器,同步装置向同步模块和合并单元测试仪发送带有IRIG‑B时钟编码的同步脉冲,通过FPGA对同步脉冲进行解码;数字调相模块提前或滞后发送采样脉冲到AD采样模块,AD采样模块接收到采样脉冲后对模拟信号采样,并转化成数字信号;控制单元读取带有时间标志的数字信号,并进行SV报文组包;SV报文通过以太网控制器发送到合并单元测试仪。本实用新型合并单元测试仪通过比较带有角差的SV报文的数字信号和采集的模拟信号来检测角差分辨率,检测方法简单且检测精度高。 | ||
搜索关键词: | 检测 合并 单元 测试仪 分辨率 装置 | ||
【主权项】:
一种检测合并单元测试仪角差分辨率的装置,包括三相模拟源、同步装置、合并单元测试仪和标准合并单元,其特征在于,所述标准合并单元包括:同步模块,所述同步装置向所述同步模块和合并单元测试仪发送带有IRIG‑B时钟编码的同步脉冲,所述同步模块通过FPGA对同步脉冲进行解码;AD采样模块,连接三相模拟源,对所述三相模拟源的模拟信号进行采样,并将模拟信号转化成数字信号;数字调相模块,接收所述同步模块解析出的秒同步时刻的同步标志,根据用户设置提前或滞后发送采样脉冲到AD采样模块,AD采样模块接收到采样脉冲后对模拟信号采样;控制单元,读取所述AD采样模块发送的带有时间标志的数字信号,并进行SV报文组包;以太网控制器,接收控制单元发送的SV报文,并发送SV报文到合并单元测试仪;所述合并单元测试仪通过比较带有角差的SV报文的数字信号和采集的模拟信号来检测角差,根据合并单元测试仪能够检测出角差时,数字调相模块提前或者滞后发送采样脉冲所导致的角差的大小来判断合并单元测试仪的角差分辨率。
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