[实用新型]一种基于FPGA的高速数据采集装置有效
| 申请号： | 201620345814.3 | 申请日： | 2016-04-22 |
| 公开（公告）号： | CN205563568U | 公开（公告）日： | 2016-09-07 |
| 发明（设计）人： | 李伟;黄作兵;郑郁;张学庆 | 申请（专利权）人： | 南京国电南自美卓控制系统有限公司 |
| 主分类号： | G06F17/40 | 分类号： | G06F17/40 |
| 代理公司： | 南京纵横知识产权代理有限公司 32224 | 代理人： | 董建林 |
| 地址： | 210032 江苏*** | 国省代码： | 江苏;32 |
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| 摘要： | 本实用新型公开了一种基于FPGA的高速数据采集装置，包括主站电路模块和与其通过BLVDS总线连接的多个从站电路模块；主站电路模块包括依次连接的CPU芯片、GPMC接口、第一FPGA芯片，第一FPGA芯片包括依次顺接的FIFO存储器、第一通信控制模块和第一BLVDS编解码模块；从站电路模块包括第二FPGA芯片和SPI接口，第二FPGA芯片包括依次顺接的第二BLVDS编解码模块、第二通信控制模块、AD数据处理模块和AD采集模块。本实用新型在采集过程中，通过过采样技术，对数据进行预处理，有效去除干扰，由FPGA扩展多块板卡，实现多路数据采集效果；同时，采集数据通过BLVDS总线进行数据传输，稳定可靠。 | ||
| 搜索关键词： | 一种 基于 fpga 高速 数据 采集 装置 | ||
【主权项】：
一种基于FPGA的高速数据采集装置，其特征在于：包括主站电路模块和多个从站电路模块；所述主站电路模块和多个从站电路模块通过BLVDS总线电连接；所述主站电路模块包括依次连接的CPU芯片、GPMC接口、第一FPGA芯片，第一FPGA芯片包括依次顺接的FIFO存储器、第一通信控制模块和第一BLVDS编解码模块；所述多个从站电路模块均包括第二FPGA芯片和SPI接口，所述第二FPGA芯片包括依次顺接的第二BLVDS编解码模块、第二通信控制模块、AD数据处理模块和AD采集模块，第二BLVDS编解码模块的数据传输端与第一BLVDS编解码模块的数据传输端连接，AD采集模块通过SPI接口采集AD数据。
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