[发明专利]一种FPGA配置数据下载装置及方法有效

专利信息
申请号: 201610066788.5 申请日: 2016-01-29
公开(公告)号: CN105760189B 公开(公告)日: 2019-03-12
发明(设计)人: 赵宁 申请(专利权)人: 北京润科通用技术有限公司
主分类号: G06F9/445 分类号: G06F9/445
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 王宝筠
地址: 100192 北京*** 国省代码: 北京;11
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摘要: 本申请提供了一种FPGA配置数据下载装置及方法,FPGA配置数据下载装置包括:ZigBee控制电路、切换电路、FPGA电路和配置芯片;ZigBee控制电路的第一控制端与切换电路的第一端相连,ZigBee控制电路的第二控制端与FPGA电路相连,ZigBee控制电路的输出端与切换电路的第二端相连;切换电路的第三端与配置芯片相连,切换电路的第四端与FPGA电路相连。在本申请中,由于不再需要连接外部数据下载线,因此在某些特殊配置数据下载场合不再需要进行大量的工作来进行外部数据下载线的连接,减少了工作量,从而缩短了FPGA配置数据下载的总时间,提高了FPGA配置数据更新效率。
搜索关键词: 一种 fpga 配置 数据 下载 装置 方法
【主权项】:
1.一种现场可编程门阵列FPGA配置数据下载装置,其特征在于,包括:紫蜂ZigBee控制电路、切换电路、FPGA电路和配置芯片;所述ZigBee控制电路的第一控制端与所述切换电路的第一端相连,所述ZigBee控制电路的第二控制端与所述FPGA电路相连,所述ZigBee控制电路的输出端与所述切换电路的第二端相连;所述切换电路的第三端与所述配置芯片相连,所述切换电路的第四端与所述FPGA电路相连;所述ZigBee控制电路,用于接收ZigBee无线信号,并对所述ZigBee无线信号进行解析,若解析出所述ZigBee无线信号中不含有FPGA配置数据,则丢弃所述ZigBee无线信号,若解析出所述ZigBee无线信号中含有FPGA配置数据,则控制所述切换电路将所述ZigBee控制电路与所述配置芯片导通连接,通过所述切换电路将所述FPGA配置数据传输至所述配置芯片,在将所述FPGA配置数据传输完毕后,控制所述切换电路将所述FPGA电路与所述配置芯片导通连接,并发送复位信号至所述FPGA电路,以使所述FPGA电路从所述配置芯片中读取所述FPGA配置数据;所述切换电路,用于通过切换实现所述配置芯片与所述ZigBee控制电路的连接或所述FPGA电路与所述配置芯片的连接;所述配置芯片,用于存储所述FPGA配置数据;所述ZigBee控制电路包括:印制电路板PCB天线、ZigBee控制器和阻抗电路;所述PCB天线与所述阻抗电路的第一端相连,所述阻抗电路的第二端与所述ZigBee控制器的RF射频外设接口相连;所述切换电路包括:第一继电器、第二继电器、第三继电器、第四继电器、第一MOS管、第二MOS管、第三MOS管和第四MOS管;所述第一MOS管的栅极、所述第二MOS管的栅极、所述第三MOS管的栅极和所述第四MOS管的栅极作为所述切换电路的第一端,均与所述ZigBee控制电路的第一控制端相连;所述第一继电器的第一端与所述ZigBee控制器的SPI总线接口的第一管脚相连,所述第二继电器的第一端与所述ZigBee控制器的SPI总线接口的第二管脚相连,所述第三继电器的第一端与所述ZigBee控制器的SPI总线接口的第三管脚相连,所述第四继电器的第一端与所述ZigBee控制器的SPI总线接口的第四管脚相连;所述第一继电器的第一端、所述第二继电器的第一端、所述第三继电器的第一端和所述第四继电器的第一端作为所述切换电路的第二端;所述ZigBee控制器的SPI总线接口的第一管脚、所述ZigBee控制器的SPI总线接口的第二管脚、所述ZigBee控制器的SPI总线接口的第三管脚和所述ZigBee控制器的SPI总线接口的第四管脚作为所述ZigBee控制电路的输出端;所述第一继电器的第二端与所述FPGA电路的SPI总线接口的第一管脚相连,所述第二继电器的第二端与所述FPGA电路的SPI总线接口的第二管脚相连,所述第三继电器的第二端与所述FPGA电路的SPI总线接口的第三管脚相连,所述第四继电器的第二端与所述FPGA电路的SPI总线接口的第四管脚相连;所述第一继电器的第三端与所述第一MOS管的漏极相连,所述第二继电器的第三端与所述第二MOS管的漏极相连,所述第三继电器的第三端与所述第三MOS管的漏极相连,所述第四继电器的第三端与所述第四MOS管的漏极相连;所述第一继电器的第四端、所述第二继电器的第四端、所述第三继电器的第四端和所述第四继电器的第四端均与电源相连;所述第一继电器的第五端与所述配置芯片的SPI总线接口的第一管脚相连,所述第二继电器的第五端与所述配置芯片的SPI总线接口的第二管脚相连,所述第三继电器的第五端与所述配置芯片的SPI总线接口的第三管脚相连,所述第四继电器的第五端与所述配置芯片的SPI总线接口的第四管脚相连;所述第一MOS管的源极、所述第二MOS管的源极、所述第三MOS管的源极和所述第四MOS管的源极分别接地。
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