[实用新型]基于FPGA的高速真有效值检波系统有效
| 申请号： | 201520331275.3 | 申请日： | 2015-05-21 |
| 公开（公告）号： | CN204649825U | 公开（公告）日： | 2015-09-16 |
| 发明（设计）人： | 赵久瑞;曹建发;王帅;张望先 | 申请（专利权）人： | 武汉大学 |
| 主分类号： | G01R19/02 | 分类号： | G01R19/02 |
| 代理公司： | 武汉科皓知识产权代理事务所(特殊普通合伙) 42222 | 代理人： | 张火春 |
| 地址： | 430072 湖*** | 国省代码： | 湖北;42 |
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| 摘要： | 本实用新型公开了一种基于FPGA的高速真有效值检波系统，包括依次连接的信号放大器、A/D转换器、FPGA模块和控制模块；本实用新型利用A/D转换器与FPGA模块结合，对待测信号进行逐步积分；为了降低噪声对测量影响，该检波器还引入了信号的中值滤波，在很大程度上提高了测量精度；本实用新型可以在待测信号的一周期，完成对信号的真有效值测量，同时具有线性范围宽、精度高，稳定性好，灵活性强等优点。 | ||
| 搜索关键词： | 基于 fpga 高速 有效值 检波 系统 | ||
【主权项】：
一种基于FPGA的高速真有效值检波系统，其特征在于：包括依次连接的信号放大器、A/D转换器、FPGA模块和控制模块；所述的FPGA模块包括中值滤波单元、绝对值单元、时间计权单元和平方和单元；所述的中值滤波单元、绝对值单元和时间计权单元依次连接，所述的平方和单元和绝对值单元连接。
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