[发明专利]转译后备缓冲器、操作其的方法以及包含其的处理器有效
申请号: | 201480065922.9 | 申请日: | 2014-11-26 |
公开(公告)号: | CN105993004B | 公开(公告)日: | 2019-04-02 |
发明(设计)人: | 柯林.艾迪;密斯瓦纳斯.摩罕 | 申请(专利权)人: | 上海兆芯集成电路有限公司 |
主分类号: | G06F12/1027 | 分类号: | G06F12/1027;G06F12/1009 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 王珊珊 |
地址: | 上海市张江高科技*** | 国省代码: | 上海;31 |
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摘要: | 一种处理器,包含一映射模块,用以将架构虚拟处理器标识符映射至非架构全域标识符并将架构程序内容标识符映射至非架构区域标识符。此处理器还包含一具有多个地址转译的转译后备缓冲器(TLB)。对于其中每个地址转译:当此地址转译为全域地址转译时,会在此地址转译加上其中一个非架构全域标识符,而映射模块已将其中一个虚拟处理器标识符映射至此非架构全域标识符;当此地址转译为区域地址转译时,会在此地址转译加上其中一个非架构区域标识符,而映射模块已将其中一个程序内容标识符映射至此非架构区域标识符。 | ||
搜索关键词: | 支持 同时 无效 共同 内容 地址 转译 | ||
【主权项】:
1.一种转译后备缓冲器,包含:多个项目,各该项目用以确保一地址转译与一有效比特向量,对于一相对应的地址转译内容,该有效比特向量的各个比特在该比特被设定时,指出该地址转译为有效,而在该比特被清除时,指出该地址转译为无效;一无效化比特向量,该无效化比特向量的比特对应于该多个项目的该有效比特向量的比特,其中,该无效化比特向量具有一设定比特以表示同时清除各该项目的该有效比特向量的相对应比特。
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