[发明专利]基于FPGA的性能测试数据流的调度方法和装置有效
| 申请号： | 201410621464.4 | 申请日： | 2014-11-06 |
| 公开（公告）号： | CN104378256B | 公开（公告）日： | 2018-09-18 |
| 发明（设计）人： | 李建国 | 申请（专利权）人： | 迈普通信技术股份有限公司 |
| 主分类号： | H04L12/26 | 分类号： | H04L12/26 |
| 代理公司： | 北京中博世达专利商标代理有限公司 11274 | 代理人： | 申健 |
| 地址： | 610041 四川省*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明实施例提供一种基于FPGA的性能测试数据流的调度方法和装置。本发明实施例涉及测试技术领域，用以解决测试设备成本高的问题。方法包括为每条测试数据流配置流长度、占用被测试端口总带宽的百分比和流请求发生器；利用流请求发生器产生测试数据流的流请求消息；对流请求发生器进行轮询，并将轮询获得的流请求消息存储在先进先出缓存器FIFO中；从FIFO中读取流请求消息，并根据流请求消息从流存储器中读取测试数据流；对读取的测试数据流进行封装，并将封装后的测试数据流发送给以太网的被测试端口。本发明实施例提供的基于FPGA的性能测试数据流的调度方法和装置，可以应用于性能测试设备中。 | ||
| 搜索关键词： | 基于 fpga 性能 测试 数据流 调度 方法 装置 | ||
【主权项】：
1.一种基于FPGA的性能测试数据流的调度方法，其特征在于，包括：为每条测试数据流配置流长度、占用被测试端口总带宽的百分比和流请求发生器，所述测试数据流与所述流请求发生器一一对应；流请求发生器接收现场可编程门阵列FPGA系统时钟信号,并在每接收到第一阈值数量的系统时钟信号后产生一个流请求消息，所述第一阈值为发送与所述流请求发生器对应的测试数据流需要经过的系统时钟的数量,所述流请求消息中包括测试数据流的流标识信息和流长度信息；对流请求发生器进行轮询，并将轮询获得的流请求消息存储在先进先出缓存器FIFO中；从FIFO中读取流请求消息，并根据所述流请求消息中的流标识信息和流长度信息从流存储器中读取测试数据流；按照以太网协议标准对读取的测试数据流进行封装，并将封装后的测试数据流发送给以太网的被测试端口。
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