[发明专利]并行数字到时间转换器架构在审
| 申请号： | 201410610123.7 | 申请日： | 2014-11-04 |
| 公开（公告）号： | CN104702306A | 公开（公告）日： | 2015-06-10 |
| 发明（设计）人： | P.马多格里奧;S.佩勒拉诺 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | H04B1/40 | 分类号： | H04B1/40 |
| 代理公司： | 中国专利代理(香港)有限公司 72001 | 代理人： | 马红梅;刘春元 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 本发明涉及并行数字到时间转换器架构。本文档尤其论述了数字到时间转换器（DTC），并且更具体地论述了DTC的并行实现。在示例中，一种装置可以包括被配置成接收参考频率信息和极坐标发射器的第一相位信息且提供相位调制信息的第一部分的第一数字到时间转换器（DTC）、被配置成接收极坐标发射器的第二相位信息且提供相位调制信息的第二部分的第二DTC、以及被配置成接收第一部分和第二部分且提供相位调制信号的组合器。 | ||
| 搜索关键词： | 并行 数字 时间 转换器 架构 | ||
【主权项】：
一种装置，包括：第一数字到时间转换器（DTC），被配置成接收参考频率信息和第一相位信息并且提供相位调制信息的第一部分；第二DTC，被配置成接收第二相位信息并且提供相位调制信息的第二部分；以及组合器，被配置成接收第一部分和第二部分并且提供相位调制信号。
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