[发明专利]一种多路时间统一的方法及装置在审

专利信息
申请号: 201410188357.7 申请日: 2014-05-07
公开(公告)号: CN104009816A 公开(公告)日: 2014-08-27
发明(设计)人: 马孝尊;贺金龙;何勇刚;高军山;杜震;冯海兵;申磊 申请(专利权)人: 中国人民解放军63892部队
主分类号: H04J3/06 分类号: H04J3/06
代理公司: 洛阳市凯旋专利事务所 41112 代理人: 陆君
地址: 471003 *** 国省代码: 河南;41
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摘要: 发明涉及时统系统技术领域,公开一种多路时间统一的方法及装置,所述方法采用的装置为多路IRIG‑B(DC)时统信号的转发与重生装置,装置中控制器的单片计算机上位计算机接口与上位计算机相连,GPS接收机接口与GPS接收机相连,GPS接收模块接口与GPS接收模块接口相连,IRIG‑B(DC)码接口与IRIG‑B(DC)码装置相连,数据端接口与操作及状态显示装置相连,输出端接口与多路IRIG‑B(DC)码差分电路相连。本发明能够多时间源输入,接收多种时间源信息,然后再转换成多路IRIG‑B(DC)码时统信号的转发、产生与输出,同时提供给多个时统用户使用,完成时间统一。
搜索关键词: 一种 时间 统一 方法 装置
【主权项】:
1.一种多路时间统一的方法,采用多路时间统一的装置,为多路IRIG-BDC时统信号的转发与重生装置,包括:多路IRIG-BDC码差分电路、控制器、操作及状态显示装置,所述控制器为单片计算机,单片计算机上设置的上位计算机接口通过信号线与上位计算机相连,单片计算机上设置的GPS接收机接口通过信号线与GPS接收机相连,其特征是:单片计算机上设置的GPS接收模块接口通过信号线与GPS接收模块接口相连,单片计算机上设置的IRIG-BDC码接口通过信号线与IRIG-BDC码装置相连,单片计算机的数据端通过数据线与操作及状态显示装置相连,单片计算机的输出端通过电缆与多路IRIG-BDC码差分电路相连;所述多路IRIG-BDC码差分电路为四路至八路IRIG-BDC码差分电路,或为八路至六十四路IRIG-BDC码差分电路,或为六十四路至n路IRIG-BDC码差分电路;其特征是:采用多路时间统一装置,接收多种时间源信息,然后再转换成多路的IRIG-BDC码时统信号输出;同时提供给多个时统用户使用,其步骤如下:1)、多路时间统一装置接收多种时间源信息,多种时间源信息包括:GPS接收机时间源信息、GPS接收模块时间源信息、IRIG-BDC码或AC码时间源信息、上位计算机时间源信息;2)、当上位计算机发送时间码信号,多路时间统一装置的控制器通过上位计算机接口,接收来自上位计算机的时间信息,并守时、解调、编码,然后按照IRIG-BDC码的格式,转换成多路的IRIG-BDC码信号,多路发送;3)、当接收来自GPS接收机的信息,多路时间统一装置的控制器通过GPS接收机接口,完成接收GPS接收机的信息,从中检出时间信息,并守时,通过解调、编码,然后按照IRIG-BDC码的格式,转换成多路的IRIG-BDC码信号,多路发送;4)、当接收来自GPS接收模块的信息,多路时间统一装置的控制器通过GPS接收模块接口,完成接收GPS接收模块的信息,从中检出时间信息,并守时,通过解调、编码,然后按照IRIG-BDC码的格式,转换成多路的IRIG-BDC码信号,多路发送;5)、当接收来自上级时统中心的一路IRIG-BDC或AC码信号,多路时间统一装置的控制器通过IRIG-BDC码接口,直接接收IRIG-BDC或AC码的时统信号,通过变换电路变换成多路的IRIG-BDC码信号,多路发送;6)、多路时间统一装置的控制器,具有自守时的时间信息,转换成IRIG-B(DC)码信号输出;即利用本地时针守时信息,按照IRIG-B码的格式要求,产生多路的IRIG-BDC码信号,多路发送;7)、多路时间统一装置的控制器,具有用户选择时间源的开关,通过显示装置状态指示来显示当前工作状态;其中所述多路的IRIG-BDC码信号为同时提供给多个时统用户使用的IRIG-BDC码信号;多路的IRIG-BDC码信号为四路至八路IRIG-BDC码信号,或为八路至六十四路IRIG-BDC码信号,或为六十四路至n路IRIG-BDC码信号。
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