[发明专利]一种基于FPGA的高速纸币冠字号码提取识别系统及其实现方法无效
| 申请号： | 201410004468.8 | 申请日： | 2014-01-06 |
| 公开（公告）号： | CN103679917A | 公开（公告）日： | 2014-03-26 |
| 发明（设计）人： | 陈镇龙;李汶洲;代君;宋昀岑;罗颖 | 申请（专利权）人： | 成都术有科技有限公司 |
| 主分类号： | G07D7/20 | 分类号： | G07D7/20 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 610000 四川省*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明公开了一种基于FPGA的高速纸币冠字号码提取识别系统，其特征在于，主要由信号后期处理模块（1），与该信号后期处理模块（1）相连接的FPGA模块（2），以及与该FPGA模块（2）相连接的两个图像采集单元构成；所述每个图像采集单元均由与FPGA模块（2）相连接的A/D转换器（3），与该A/D转换器（3）相连接的控制信号驱动电路（4）和信号调理电路模块（5），以及与该控制信号驱动电路（4）和信号调理电路模块（5）同时相连接的CIS图像传感器（6）组成。本发明采用FPGA模块作为全局控制核心，不仅其运行速率高、具有丰富的逻辑单元及I/O接口，而且还能有效的完成对整体系统的综合调度。 | ||
| 搜索关键词： | 一种 基于 fpga 高速 纸币 字号 提取 识别 系统 及其 实现 方法 | ||
【主权项】：
一种基于FPGA的高速纸币冠字号码提取识别系统，其特征在于，主要由信号后期处理模块（1），与该信号后期处理模块（1）相连接的FPGA模块（2），以及与该FPGA模块（2）相连接的两个图像采集单元构成；所述每个图像采集单元均由与FPGA模块（2）相连接的A/D转换器（3），与该A/D转换器（3）相连接的控制信号驱动电路（4）和信号调理电路模块（5），以及与该控制信号驱动电路（4）和信号调理电路模块（5）同时相连接的CIS图像传感器（6）组成。
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