[发明专利]一种VGA全分辨率锁定显示系统及方法有效

专利信息
申请号: 201310723371.8 申请日: 2013-12-25
公开(公告)号: CN104754272B 公开(公告)日: 2018-11-20
发明(设计)人: 袁扬智;刘俊秀;石岭 申请(专利权)人: 深圳开阳电子股份有限公司
主分类号: H04N5/765 分类号: H04N5/765;H04N7/01
代理公司: 暂无信息 代理人: 暂无信息
地址: 518057 广东省深圳市南*** 国省代码: 广东;44
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摘要: 发明实施例公开了一种VGA全分辨率锁定显示系统,该系统包括三路ADC、视频格式转换单元、缩放单元、输出后处理及显示单元、DDS、行锁单元、自动显示调整单元、视频检测单元;本发明还提出了一种VGA全分辨率锁定显示方法,本发明所述系统及方法使得输入的VGA信号不受分辨率的限制均可显示输出。
搜索关键词: 一种 vga 分辨率 锁定 显示 系统 方法
【主权项】:
1.一种VGA全分辨率锁定显示系统,其特征在于,包括:三路ADC,用于将输入的RGB输入数据R_in、G_in、B_in转换为数字的RGB数据,输出至视频格式转换单元;视频格式转换单元,用于将输入的RGB数字信号转换为其它的视频格式,再输入至缩放单元;视频检测单元,用于根据输入的行同步信号Hsync_in、Vsync_in、clk_in,检测输入信号的分辨率,检测得到的分辨率信息输出至行锁单元和缩放单元;若检测得到当前分辨率信息不在检测范围,则按照任意分辨率显示模式配置行锁单元、自动显示调整单元和缩放单元;自动显示调整单元,用于当所述视频检测单元检测当前分辨率信息不在检测范围内,则根据所述视频检测单元输出的一行总点数和一场总行数,设置所述缩放单元的水平缩放比例和垂直缩放比例,使当前输入的任意分辨率的VGA视频信号能够正确显示到所接的后处理及显示单元上,并将一行总点数输入至所述缩放单元;同时设置行锁单元的输入时钟频率为一固定时钟频率;行锁单元,用于控制DDS得到与行同步信号精确锁相的时钟信号clk_pixel,作为所述行锁单元、缩放单元的输入时钟;DDS,用于通过所述行锁单元输出的控制信号Dto_inc及输入时钟信号clk_in,得到调整后的时钟信号clk_pixel;缩放单元,用于对输入的视频图像数据,按照设定的缩放比例进行缩放处理后输出至后处理及显示单元,所述缩放处理包括水平方向缩放和垂直方向缩放;后处理及显示单元,用于对缩放处理后的视频图像进行处理并显示输出。
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