[发明专利]一种基于FPGA设计的脉位编码同步头捕获模块及捕获方法无效
| 申请号： | 201310189133.3 | 申请日： | 2013-05-21 |
| 公开（公告）号： | CN103268138A | 公开（公告）日： | 2013-08-28 |
| 发明（设计）人： | 王力 | 申请（专利权）人： | 四川九洲电器集团有限责任公司 |
| 主分类号： | G06F1/12 | 分类号： | G06F1/12 |
| 代理公司： | 成都九鼎天元知识产权代理有限公司 51214 | 代理人： | 詹永斌 |
| 地址： | 621000*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明公开了一种基于FPGA设计的脉位编码同步头捕获模块及捕获方法，所述模块包括4个功能单元：同步头脉宽筛选单元，脉宽缓存单元，同步头脉冲间隔计时单元，同步头脉宽比对单元。其捕获方法是：同步头脉宽筛选单元从脉位编码序列中筛选出符合脉宽要求的同步头P1并缓存至脉宽缓存单元；同步头脉冲间隔计时单元启动计数器开始计时，计时到同步头脉冲间隔时间后脉宽缓存单元输出同步头P1并送入同步头脉宽比对单元，将同步头与实时输入的脉冲P2进行比对，若两者能够重合，则实现同步头的成功捕获。使用本发明，大大降低了FPGA的逻辑资源占用率，提升了实用性，使项目中FPGA设计得到优化。 | ||
| 搜索关键词： | 一种 基于 fpga 设计 编码 同步 捕获 模块 方法 | ||
【主权项】：
一种基于FPGA设计的脉位编码同步头捕获模块，其特征在于：包括4部分：同步头脉宽筛选单元，脉宽缓存单元，同步头脉冲间隔计时单元，同步头脉宽比对单元；其中同步头脉宽筛选单元用于从脉位编码脉冲序列中筛选出符合脉宽要求的同步头P1；脉宽缓存单元用于缓存同步头P1的脉宽，并在同步头脉冲间隔时间达到时输出同步头P1的脉宽；同步头脉冲间隔计时单元用于启动计数器开始计时，计时时间到达脉冲间隔后，使脉宽缓存单元输出同步头P1的脉宽；同步头脉宽比对单元用于将同步头P1的脉宽与实时输入的脉冲P2进行比对。
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