[发明专利]一种两段式时间数字转换电路无效

专利信息
申请号: 201310076113.5 申请日: 2013-03-11
公开(公告)号: CN103208994A 公开(公告)日: 2013-07-17
发明(设计)人: 郑丽霞;吴金;杨俊浩;董怀朋;孙伟锋;宋慧滨;高新江;孙力军;张秀川;蒋利群 申请(专利权)人: 东南大学
主分类号: H03M1/50 分类号: H03M1/50
代理公司: 南京经纬专利商标代理有限公司 32200 代理人: 朱小兵
地址: 214135 江*** 国省代码: 江苏;32
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摘要: 发明公开了一种两段式时间数字转换(TDC)电路,包括第一计数器部分和第二计数器部分,其中第一计数器部分包括延迟单元、译码电路、锁存器,采用闭环延迟线式结构,第二计数器部分采用伪随机序列计数器,所述两段式时间数字转换电路采用门控信号控制,可重复开关,初态确定且启动迅速;该电路用于阵列型红外三维成像读出电路,根据需要将电路配置于象素外、象素内或部分置于象素外;相比于普通TDC电路,本发明电路结构简单,可工作于较高频率,提高时间分辨率的同时产生稳定的振荡频率;满足阵列型红外传感读出电路中象素电路面积小、功耗低、时间分辨率高的应用需求。
搜索关键词: 一种 段式 时间 数字 转换 电路
【主权项】:
一种两段式时间数字转换电路,其特征在于:包括第一计数器和第二计数器,其中所述第一计数器包括n级延迟单元、译码电路、锁存器;所述第二计数器采用伪随机码计数器结构,其中,外部输入信号依次经过n级延迟单元后输出至第二计数器,所述第二计数器对延迟单元的输出信号进行处理,然后将处理后的信号输入到锁存器;同时n级延迟单元产生2n个相位状态输出到译码电路,所述译码电路将2n个相位状态译码成二进制码并输入到锁存器;在锁存器中,所述二进制码与所述第二计数器输入到锁存器的信号合并,并通过外部停止脉冲信号对合并后的信号进行锁存控制,锁存后的信号作为所述两段式时间数字转换电路的输出信号,其中n为大于0的自然数。
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