[发明专利]在一种FPGA互联线测试方法无效
| 申请号： | 201110255086.9 | 申请日： | 2011-08-31 |
| 公开（公告）号： | CN102736023A | 公开（公告）日： | 2012-10-17 |
| 发明（设计）人： | 孙铁力 | 申请（专利权）人： | 深圳市国微电子股份有限公司 |
| 主分类号： | G01R31/317 | 分类号： | G01R31/317 |
| 代理公司： | 深圳市科吉华烽知识产权事务所 44248 | 代理人： | 胡吉科;于标 |
| 地址： | 518057 广东省深圳市*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明提供一种FPGA互联线测试方法，包括如下步骤：信号步骤：在FPGA内部建立测试电路，由该测试电路产生测试信号；驱动步骤：所述测试信号输入到驱动电路然后输出驱动测试信号；测试步骤：所述测试信号输入到被测试模块，获得相应的输出信号，以判定被测试模块的互联线状况。 | ||
| 搜索关键词： | 一种 fpga 互联线 测试 方法 | ||
【主权项】：
一种FPGA互联线测试方法，其特征在于，包括如下步骤：信号步骤：在FPGA内部建立测试电路，由该测试电路产生测试信号；驱动步骤：所述测试信号输入到驱动电路然后输出驱动测试信号；测试步骤：所述测试信号输入到被测试模块，获得相应的输出信号，以判定被测试模块的互联线状况；其中，所述被测试模块采用接口模块；相应的，所述驱动电路采用接口缓冲模块，将所述测试电路产生的电平信号转化成匹配于所述接口模块输入的电平信号。
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