[发明专利]发送电路和通信系统有效
| 申请号： | 201110218952.7 | 申请日： | 2011-08-02 |
| 公开（公告）号： | CN102377703A | 公开（公告）日： | 2012-03-14 |
| 发明（设计）人： | 下村幸雄 | 申请（专利权）人： | 索尼公司 |
| 主分类号： | H04L25/02 | 分类号： | H04L25/02 |
| 代理公司： | 北京市柳沈律师事务所 11105 | 代理人： | 黄小临 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 一种发送电路和通信系统，包括：彼此并行布置的多个线路块，被配置以将从对应的线路供应的并行数据转换为串行数据，并输出所述串行数据；以及时钟使能器块，包括至少一个时钟使能器，用于响应于使能信号，在驱动时钟的多个周期之后向所述多个线路块输出用基准时钟锁定相位的所述驱动时钟。所述多个线路块的每个具有：分频器，用于划分从所述块使能器块供应的所述驱动时钟以生成分频时钟和负载信号，以及并行到串行转换器，用于与所述分频器生成的分频时钟和负载信号以及所述时钟使能器块生成的驱动时钟同步地，将从所述对应的线路供应的并行数据转换为串行数据。 | ||
| 搜索关键词： | 发送 电路 通信 系统 | ||
【主权项】：
一种发送电路，包括：彼此并行布置的多个线路块，被配置以将从对应的线路供应的并行数据转换为串行数据，并输出所述串行数据；以及时钟使能器块，包括至少一个时钟使能器，用于响应于使能信号，在驱动时钟的多个周期之后向所述多个线路块输出用基准时钟锁定相位的所述驱动时钟；所述多个线路块的每个具有分频器，用于划分从所述块使能器块供应的所述驱动时钟以生成分频时钟和负载信号，以及并行到串行转换器，用于与所述分频器生成的分频时钟和负载信号以及所述时钟使能器块生成的驱动时钟同步地，将从所述对应的线路供应的并行数据转换为串行数据。
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