[发明专利]一种嵌入式列车图像检测系统有效

专利信息
申请号: 201110055936.0 申请日: 2011-03-08
公开(公告)号: CN102158377A 公开(公告)日: 2011-08-17
发明(设计)人: 石文轩;李婕;黄腾;夏巧桥;陈曦;张青林;宋冬立 申请(专利权)人: 武汉大学
主分类号: H04L12/28 分类号: H04L12/28;H04N7/18;H04L29/08
代理公司: 武汉科皓知识产权代理事务所(特殊普通合伙) 42222 代理人: 张火春
地址: 430072 湖*** 国省代码: 湖北;42
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摘要: 发明公开了一种嵌入式列车图像检测系统,包括千兆网相机、千兆网接口电路、百兆网接口电路、数据采集与控制电路、图像压缩电路、串口硬盘、串口硬盘接口电路、列车进/出站检测仪、RS232接口电路、触发控制板和服务器,其中,数据采集与控制电路通过千兆网接口电路、百兆网接口电路、串口硬盘接口电路、RS232接口电路分别与千兆网相机、服务器、串口硬盘、列车进/出站检测仪相连,触发控制板同时与数据采集与控制电路、列车进/出站检测仪相连,图像压缩电路同时与数据采集与控制电路、串口硬盘接口电路相连。与传统的列车图像检测系统相比,本发明降低了系统的复杂性、成本、体积和功耗,提高了系统的稳定性,并具有优异的鲁棒性。
搜索关键词: 一种 嵌入式 列车 图像 检测 系统
【主权项】:
一种嵌入式列车图像检测系统,其特征在于,包括:千兆网相机(1)、千兆网接口电路(2)、百兆网接口电路(3)、数据采集与控制电路(4)、图像压缩电路(5)、串口硬盘(6)、串口硬盘接口电路(7)、列车进/出站检测仪(8)、RS232接口电路(9)、触发控制板(10)和服务器(11),其中,数据采集与控制电路(4)通过千兆网接口电路(2)、百兆网接口电路(3)、串口硬盘接口电路(7)、RS232接口电路(9)分别与千兆网相机(1)、服务器(11)、串口硬盘(6)、列车进/出站检测仪(8)相连,触发控制板(10)同时与数据采集与控制电路(4)、列车进/出站检测仪(8)相连,图像压缩电路(5)同时与数据采集与控制电路(4)、串口硬盘接口电路(7)相连;所述的千兆网接口电路(2)包括千兆位以太网收发器(21)、网络变压器(22)、网络接口(23)、状态灯显示电路(24)和电压保护电路(25),其中,千兆位以太网收发器(21)、网络变压器(22)、网络接口(23)依次相连,千兆位以太网收发器(21) 的输出连接状态灯显示电路(24)、输入连接电压保护电路(25),千兆位以太网收发器(21)还与千兆网接口电路接口(41)相连,网络接口(23)与千兆网相机(1)相连;所述的数据采集与控制电路(4)由相互连接的FPGA和DSP构成,其中,FPGA包括千兆网接口电路接口(41)、串口硬盘接口电路接口(42)、触发信号接口(43),DSP包括有 VPORT接口(44)、EMIF接口(45)、UART接口(46)和百兆网接口(47),千兆网接口电路接口(41) 与千兆位以太网收发器(21)连接,串口硬盘接口电路接口(42)与串口硬盘协议芯片(71)连接,触发信号接口(43)的输入与触发信号输出接口(103)连接,千兆网接口电路接口(41)和触发信号接口(43)的输出端均与图像压缩电路(5)的输入端连接,VPORT接口(44)和EMIF接口(45)的输入端均与图像压缩电路(5)的输出端连接,UART接口(46)的输入端与UART收发器(93)相连,百兆网接口(47)与百兆网接口电路(3)连接;所述的图像压缩电路(5)由依次相连的数据输入接口(51)、数据预处理电路(52)、数据缓存与2维DCT变换电路(53)、Zigzag编码电路(54)、量化电路(55)、霍夫曼编码电路(56)和码流并串转换电路(57)构成,其中,数据输入接口(51)的输入端与千兆网接口电路接口(41)、触发信号接口(43)连接,码流并串转换电路(57)的输出端与VPORT接口(44)、EMIF接口(45)和串口硬盘协议芯片(71)连接;所述的串口硬盘接口电路(7)包括串口硬盘协议芯片(71)、串口硬盘线的接插件(72)和电压保护电路(73),其中,串口硬盘协议芯片(71)与电压保护电路(73)、码流并串转换电路(57)、串口硬盘接口电路接口(42)连接,其输出与串口硬盘线的接插件(72)连接,串口硬盘线接插件(72)与串口硬盘(6)连接;所述的RS232接口电路(9)由依次相连的RS232‑A接口(91)、多通道RS232线性驱动/接收器(92)和UART收发器(93)构成,RS232‑A接口(91)连接列车进/出站检测仪(8)和多通道RS232线性驱动/接收器(92)的输入端,多通道RS232线性驱动/接收器(92)的输出端与UART收发器(93)的接收端连接,UART收发器(93)的发送端与UART接口(46)连接;所述的触发控制板(10)包括触发信号输入接口(101)、FPGA(102)和触发信号输出接口(103),FPGA (102)分别与触发信号输入接口(101)的输出端和触发信号输出接口(103)的输入端相连。
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