[发明专利]一种加速视频解码的方法有效

专利信息
申请号: 200910031328.9 申请日: 2009-05-08
公开(公告)号: CN101605258A 公开(公告)日: 2009-12-16
发明(设计)人: 戴麟;时龙兴;杨军;刘新宁;谈力立;罗锋 申请(专利权)人: 东南大学
主分类号: H04N7/26 分类号: H04N7/26;H04N7/50
代理公司: 南京经纬专利商标代理有限公司 代理人: 奚幼坚
地址: 21009*** 国省代码: 江苏;32
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摘要: 一种加速视频解码的方法,系采用软、硬件协同解码的方式,首先使用软件解码程序进行MPEG4解码并统计各个模块占用CPU的资源,通过对解码算法和统计结果的分析,将MPEG4解码中运算比较集中、耗费CPU资源比较多、有通用性的部分,包括反离散余弦变换(IDCT)、可变长解码(VLC)、帧间块的反扫描、反量化和运动补偿改由用硬件模块完成并与设置的控制逻辑模块、下属模块(slave)、主模块(master)以及两块存储空间,以上硬件模块共同构成硬件加速器,使用性能较低的处理器(如ARM7TDMI)+硬件加速器,可完成至少CIF(352x288)分辨率视频文件的实时解码。
搜索关键词: 一种 加速 视频 解码 方法
【主权项】:
1、一种加速视频解码的方法,系采用软、硬件协同解码的方式,其特征在于:对MPEG4解码流程进行分析,将MPEG4解码中运算比较集中、耗费CPU资源比较多、有通用性的部分,包括反离散余弦变换、可变长解码、帧间块的反扫描、反量化和运动补偿改由用硬件模块完成并与设置的控制逻辑模块、下属模块、主模块以及两块存储空间,其中一块用于反离散余弦变换的X存储空间,另一块用于运动补偿的Y存储空间;以上硬件模块共同构成硬件加速器,其中,控制逻辑模块控制各个模块的运行;下属模块负责接收总线数据,配置寄存器;主模块负责调配数据;硬件加速器在低频率的嵌入式处理器上至少完成352x288分辨率视频文件的实时解码。
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