[发明专利]一种并行的高速动态元件匹配方法有效
| 申请号： | 200910030063.0 | 申请日： | 2009-03-30 |
| 公开（公告）号： | CN101567692A | 公开（公告）日： | 2009-10-28 |
| 发明（设计）人： | 吴建辉;朱贾峰;陈超;李红;曲子华;汤黎明;袁渊;王声扬;马潇 | 申请（专利权）人： | 东南大学 |
| 主分类号： | H03M1/06 | 分类号： | H03M1/06 |
| 代理公司： | 南京经纬专利商标代理有限公司 | 代理人： | 叶连生 |
| 地址： | 21009*** | 国省代码： | 江苏;32 |
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| 摘要： | 并行的高速动态元件匹配方法主要是降低了动态元件匹配算法的建立时间和硬件的复杂度，尤其适合需要高线性度的高速DAC的应用。并行转换模块(21)的输入是一个多位的串行或并行的二进制序列(Bin)，经过并行转换模块(21)使得按每位的权重从高到低并行输出，即输出XnXn-1…X1，其中Xn为输入信号的最高位；并行转换模块(21)的二进制输出连到位译码单元(22)，根据二进制输入信号的位权重，对每一位分别进行译码，二进制输入的其中一位Xi被译码为2i-1个Xi，1≤i≤n；伪随机序列产生模块(24)提供开关阵列(23)的控制信号，位译码单元(22)的输出编码连接到由伪随机序列控制的开关阵列模块(23)，从而实现部分随机的选择输出编码，达到动态元件匹配。 | ||
| 搜索关键词： | 一种 并行 高速 动态 元件 匹配 方法 | ||
【主权项】：
1.一种并行的高速动态元件匹配方法，其特征在于包括一个从高位到低位排列的并行转换模块(21)、根据每位的权重实现每位温度译码的位译码单元(22)、由开关并行排列的开关阵列(23)和一个伪随机序列产生模块(24)；并行转换模块(21)的输入是一个多位的串行或并行的二进制序列(Bin)，经过并行转换模块(21)使得按每位的权重从高到低并行输出，即输出XnXn-1…X1，其中Xn为输入信号的最高位；并行转换模块(21)的二进制输出连到位译码单元(22)，根据二进制输入信号的位权重，对每一位分别进行译码，二进制输入的其中一位Xi被译码为2i-1个Xi，1≤i≤n；伪随机序列产生模块(24)提供开关阵列(23)的控制信号，位译码单元(22)的输出编码连接到由伪随机序列控制的开关阵列模块(23)，从而实现部分随机的选择输出编码，达到动态元件匹配。
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