[发明专利]数据输出电路和方法无效
申请号: | 200910006037.4 | 申请日: | 2009-01-22 |
公开(公告)号: | CN101740104A | 公开(公告)日: | 2010-06-16 |
发明(设计)人: | 李康悦 | 申请(专利权)人: | 海力士半导体有限公司 |
主分类号: | G11C7/10 | 分类号: | G11C7/10 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 杨林森;康建峰 |
地址: | 韩国京畿*** | 国省代码: | 韩国;KR |
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摘要: | 提供了一种数据输出电路和方法,所述电路包括:选通信号控制块,被配置成通过将第一选通信号延迟特定的延迟量而产生至少一个第一延迟选通信号;输入/输出读出放大块,被配置成响应于所述第一选通信号和所述第一延迟选通信号而放大第一并行数据信号,以产生具有与所述第一并行数据信号的比特数量相同的比特数量的第二并行数据信号;存储块,被配置成响应于第二选通信号和第二延迟选通信号来锁存所述第二并行数据信号;以及并行到串行转换块,被配置成顺序地输出被锁存在所述存储块内的所述第二并行数据信号,其中,所述第一选通信号用于产生所述第二并行数据信号中的首先被输出的数据信号。 | ||
搜索关键词: | 数据 输出 电路 方法 | ||
【主权项】:
一种数据输出电路,包括:选通信号控制块,所述选通信号控制块被配置成通过将第一选通信号延迟特定的延迟量而产生至少一个第一延迟选通信号;读出放大块,所述读出放大块被配置成响应于所述第一选通信号和所述至少一个第一延迟选通信号而放大第一并行数据信号,以产生具有与所述第一并行数据信号的比特数量相同的比特数量的第二并行数据信号;存储块,所述存储块被配置成响应于第二选通信号和通过延迟所述第二选通信号而产生的第二延迟选通信号来锁存所述第二并行数据信号;以及并行到串行转换块,所述并行到串行转换块被配置成顺序地输出被锁存在所述存储块内的所述第二并行数据信号,其中,所述第一选通信号用于产生所述第二并行数据信号中首先被输出的数据信号。
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