[实用新型]一种基于SOC设计的雷达信号基带处理芯片无效
申请号: | 200720081043.2 | 申请日: | 2007-09-12 |
公开(公告)号: | CN201107404Y | 公开(公告)日: | 2008-08-27 |
发明(设计)人: | 何春;宗竹林;李磊;刘辉华;张林;刘伟;李蜀霞;黎亮;周婉婷;饶全林 | 申请(专利权)人: | 电子科技大学 |
主分类号: | G01S7/02 | 分类号: | G01S7/02;G06F17/00;G06F13/40 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 610054四*** | 国省代码: | 四川;51 |
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摘要: | 一种基于SOC设计的雷达信号基带处理芯片,第一次运用SOC设计思想来完成雷达信号基带处理,核心思想是将雷达信号基带处理所需要的功能模块尽可能地集成到一个芯片中,同时提高芯片的通用性,雷达信号处理的脉冲压缩、滤波处理、求模和取对数模块均用硬件实现,数据结果分析用CPU处理模块来完成,由于这些功能模块都集成到一块芯片中,因此各模块间具有很高的通讯速度、较大数据处理量以及较小的功耗。本实用新型主要应用于雷达信号基带处理。 | ||
搜索关键词: | 一种 基于 soc 设计 雷达 信号 基带 处理 芯片 | ||
【主权项】:
1.一种基于SOC设计的雷达信号基带处理芯片,包括时钟模块(1)、模式选择模块(2)、参数控制模块(3)、CPU处理模块(4),其特征在于,基于SOC设计的雷达信号基带处理芯片还设有一个协处理器(5),时钟模块(1)分别与模式选择模块(2)、CPU处理模块(4)、协处理器(5)通过单向总线相连,参数控制模块(3)分别与模式选择模块(3)、CPU处理模块(4)、协处理器(5)通过单向总线相连,协处理器(5)与CPU处理模块(4)之间通过交互总线连接。
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