[发明专利]访问控制装置、系统和方法,处理器无效

专利信息
申请号: 200710084379.9 申请日: 2007-02-28
公开(公告)号: CN101042682A 公开(公告)日: 2007-09-26
发明(设计)人: 金井达德;吉井谦一郎 申请(专利权)人: 株式会社东芝
主分类号: G06F12/14 分类号: G06F12/14;G06F12/08;G06F11/10
代理公司: 永新专利商标代理有限公司 代理人: 王英
地址: 日本*** 国省代码: 日本;JP
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摘要: 一种访问控制装置,包括:写入方校正子生成器,其生成写入方掩码数据的写入方校正子以对添加了奇偶校验码的数据进行掩码,所述写入方校正子与当所述写入方访问所述存储器时使用的写入方访问ID相关联,所述写入方请求将所述写数据写入所述存储器;写掩码生成器,其根据所述写入方校正子、所述写入方访问ID以及所述写入方在所述存储器中写入所述写数据的写地址来生成所述写入方掩码数据;第一XOR计算器,其通过计算所述添加了奇偶校验码的数据与所述写入方掩码数据之间的XOR来获得第一运算后数据;写地址转换器,其将所述写地址转换为根据所述写入方访问ID确定的另一个地址。
搜索关键词: 访问 控制 装置 系统 方法 处理器
【主权项】:
1.一种访问控制装置,其控制写入方、读出方和存储器之间的访问,所述访问控制装置包括:奇偶校验码生成器,其生成将写入所述存储器的写数据的奇偶校验码;奇偶校验码添加器,其将所述奇偶校验码添加到所述写数据以生成添加了奇偶校验码的数据;写入方校正子生成器,其生成写入方掩码数据的写入方校正子以对所述添加了奇偶校验码的数据进行掩码,所述写入方校正子与当所述写入方访问所述存储器时使用的写入方访问ID相关联,所述写入方请求将所述写数据写入所述存储器;写掩码生成器,其根据所述写入方校正子、所述写入方访问ID以及所述写入方在所述存储器中写入所述写数据的写地址来生成所述写入方掩码数据;第一XOR计算器,其通过计算所述添加了奇偶校验码的数据与所述写入方掩码数据之间的XOR来获得第一运算后数据;写地址转换器,其将所述写地址转换为根据所述写入方访问ID确定的另一个地址;写单元,其将所述第一运算后数据写到由所述写地址转换器转换后的地址;读出方校正子生成器,其生成读出方掩码数据的读出方校正子以对所述第一运算后数据进行掩码,所述读出方校正子与当所述读出方访问所述存储器时使用的读出方访问ID相关联,所述读出方请求从所述存储器读数据;读出方掩码生成器,其根据所述读出方校正子、所述读出方访问ID以及所述读出方从所述存储器中读取所述读数据的读地址来生成所述读出方掩码数据;读地址转换器,其将所述读地址转换为根据所述读出方访问ID确定的另一个地址;读单元,其从由所述读地址转换器转换后的地址读取所述第一运算后数据;第二XOR计算器,其通过计算所述读出方掩码数据与所述第一运算后数据之间的XOR来获得第二运算后数据;数据校正子计算器,其根据所述第二运算后数据计算实际的数据校正子;以及输出确定单元,其根据所述实际的数据校正子确定是否将所述第二运算后数据作为由所述读出方请求读取的读数据来输出。
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