[发明专利]乘法装置无效
| 申请号： | 200580028748.1 | 申请日： | 2005-07-13 |
| 公开（公告）号： | CN101010665A | 公开（公告）日： | 2007-08-01 |
| 发明（设计）人： | 武内大辅;田上一文 | 申请（专利权）人： | 松下电器产业株式会社 |
| 主分类号： | G06F7/533 | 分类号： | G06F7/533 |
| 代理公司： | 北京市金杜律师事务所 | 代理人： | 季向冈 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供一种乘法装置，求出作为以二进制补码表示的定点数的被乘数与作为以二进制补码表示的定点数的乘数进行乘法运算的积，包括：编码部，基于二阶布斯算法对上述乘数进行编码，输出所取得的多个编码结果；溢出检测部，在上述被乘数与上述乘数同为负的最大值时，检测出溢出发生；以及部分积生成部，生成并输出上述被乘数与上述多个编码结果的每一个之间的多个部分积，和与上述多个部分积的每一个对应的多个修正项。部分积生成部，在溢出检测部检测出溢出的发生时，将上述多个部分积和上述多个修正项中的任一者修正来进行输出，以使乘法运算结果成为正的最大值。 | ||
| 搜索关键词： | 乘法 装置 | ||
【主权项】：
1.一种乘法装置，求出作为以二进制补码表示的定点数的被乘数与作为以二进制补码表示的定点数的乘数进行乘法运算的积，其特征在于，包括：编码部，基于二阶布斯算法对上述乘数进行编码，输出所取得的多个编码结果；溢出检测部，在上述被乘数与上述乘数同为负的最大值时，检测出溢出的发生；部分积生成部，生成并输出上述被乘数与上述多个编码结果的每一个之间的多个部分积，和与上述多个部分积的每一个对应、用于与对应的部分积相加以取得该部分积的二进制补码的多个修正项；累加部，进行上述多个部分积和上述多个修正项的累加运算，压缩成2个中间积以进行输出；以及最终加法部，进行上述2个中间积的加法运算，将其结果作为乘法运算结果输出，上述部分积生成部，在上述溢出检测部检测出溢出的发生时，将上述多个部分积和上述多个修正项中的任一者修正来进行输出，以使上述乘法运算结果成为正的最大值。
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