[实用新型]音、视频数字信号分时传输装置无效
申请号: | 200520120835.7 | 申请日: | 2005-12-15 |
公开(公告)号: | CN2857376Y | 公开(公告)日: | 2007-01-10 |
发明(设计)人: | 梁宁 | 申请(专利权)人: | 康佳集团股份有限公司 |
主分类号: | H04N7/18 | 分类号: | H04N7/18;H04N7/54 |
代理公司: | 深圳市智科友专利商标事务所 | 代理人: | 曲家彬 |
地址: | 518053广东省深圳*** | 国省代码: | 广东;44 |
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摘要: | 本实用新型公开了音、视频信号在一条线路上实现分时传输的装置,该装置设在视频数字信号传输线路的两端,包括在信号发送单元、信号接收单元两大部分电路,发送单元中包括音频信号A/D转换器、缓存器和专用发送芯片,信号接收单元包括音频信号D/A转换器、缓存器和专用接受芯片,转化后的音频数字信号借助于软件支持,在行同步头区间经并串转换后发送至接收单元,再还原为模拟音频信号与视频信号同步输出。 | ||
搜索关键词: | 视频 数字信号 分时 传输 装置 | ||
【主权项】:
1.音、视频数字信号分时传输装置,该装置包括数字信号传输线路(3)及设定传输线路(3)两端的数字信号发送单元(1)、数字信号接收单元(2)两部分电路,其特征在于:所述的信号发送单元(1)包括:音频A/D转换器(4),其信号输入端与待传音频信号输出端口相连,音频A/D转换器(4)的输出端口接至缓存器(5)的写端口,从缓存器(5)按编组就序读出的数字音频信号从输出端口引出与数字视频信号并行接至发送器(7)的数字信号输入端,数字视频信号传输的控制与时序信号接在发送器(7)相应的数字信号输入端口上,缓存器(5)的结构是由暂存器(5A)和时序控制器(5B)组成,暂存器(5A)的写时钟信号端与音频A/D转换器(4)连接在同一采样时钟的信号(sclk),暂存器(5A)的读时钟信号端接视频并行数据时钟信号(DCLK),写请求信号控制端固定接高电平,读信号控制端接在时序控制器(5B)的控制信号输出端,时序控制器(5B)的输入端口与视频行同步信号(Hsync)和视频时钟信号(DCLK)相连;所述的信号接收单元(2)包括:接收器(8),其信号输入端与一端连接于发送器(7)的输出端口的信号传输线(3)的另一端相连,从接收器(8)的对应的数据输出端口引出的视频信号引至本装置的输出端口,对应音频信号引出端则连接在缓存器(9)的数字信号输入端,音频D/A转换器(6)的信号输入端与缓存器(9)的信号输出端相连,缓存器(9)的结构由暂存器(9A)和时序控制器(9B)组成,暂存器(9A)的读请求信号端接高电平,暂存器(9A)的写时钟信号端接视频时钟信号(DCLK),读时钟信号端连接采样时钟的信号(sclk),写请求信号控制端接时序控制器(9B)的控制信号输出端,视频行同步信号(Hsync)和视频并行数据时钟信号(DCLK)接在时序控制器(9B)的控制信号输入端,由缓存器(9)输出的数字音频信号经D/A转换器(6)转换为模拟信号引至本装置的音频信号输出端口。
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