[实用新型]显示器数字图像缩放中的数据有效信号产生电路无效
| 申请号： | 03216709.1 | 申请日： | 2003-04-22 |
| 公开（公告）号： | CN2613020Y | 公开（公告）日： | 2004-04-21 |
| 发明（设计）人： | 何云鹏;战嘉瑾;丁勇;刘志恒;陈永强;缪建兵 | 申请（专利权）人： | 海信集团有限公司 |
| 主分类号： | G09G5/00 | 分类号： | G09G5/00;G09G5/18;G09G5/373 |
| 代理公司： | 青岛联智专利商标事务所有限公司 | 代理人： | 宫乃斌 |
| 地址： | 266071*** | 国省代码： | 山东;37 |
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| 摘要： | 一种显示器数字图像缩放中的数据有效信号产生电路，属于显示器技术。它包括输入系数Coef[5:0]、水平缩放步长hstep[6:0]、目标时钟des－clk和低有效复位信号rst－n的依次连接的第一个加法器、选择器和寄存器，第二个加法器、选择器和寄存器，两个比较器，将两个比较器的比较结果相或的或门，将或结果与输入信号vde－start相或的或门以及分别输入该或结果cnt－rst得到行数据有效信号HDE和场数据有效信号VDE的行计数器和场计数器。行计数器和场计数器还和与门相连，以得到混合的数据有效信号DE。它处理结果非常准确，电路简单，可靠性高。可广泛应用于各类显示器的数字图像缩放电路中。 | ||
| 搜索关键词： | 显示器 数字图像 缩放 中的 数据 有效 信号 产生 电路 | ||
【主权项】：
1.一种显示器数字图像缩放中的数据有效信号产生电路，其特征在于它包括输入系数Coef[5:0]、水平缩放步长hstep[6:0]、目标时钟des-clk和低有效复位信号rst-n的依次连接的第一个加法器、选择器和寄存器，与第一个加法器、选择器和寄存器连接的第二个加法器、选择器和寄存器，与第二个加法器、选择器和寄存器连接的两个比较器，将两个比较器的比较结果相或的或门，将或结果与输入信号vde-start相或的或门以及分别输入该或结果cnt-rst得到行数据有效信号HDE和场数据有效信号VDE的行计数器和场计数器。
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