[发明专利]数据内插装置及方法、样本化函数产生装置、数据内插程序、记录媒体无效
| 申请号: | 02811499.X | 申请日: | 2002-05-23 |
| 公开(公告)号: | CN1515073A | 公开(公告)日: | 2004-07-21 |
| 发明(设计)人: | 小柳裕喜生 | 申请(专利权)人: | 神经网络处理有限公司 |
| 主分类号: | H03H17/00 | 分类号: | H03H17/00;G06F17/17 |
| 代理公司: | 中科专利商标代理有限责任公司 | 代理人: | 李香兰 |
| 地址: | 日本国*** | 国省代码: | 日本;JP |
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| 摘要: | 一种数据内插装置,具备:可使依次输入的分散数据延迟的多级延迟电路1-1、2-1、3-1;以及,对从多级延迟电路1-1、2-1、3-1的各输出级取出的各数据,进行对应数字基本函数(-1、1、8、8、1、-1)值的加权加法运算,由此求比内插数据的乘加法运算电路4-1~16-1,根据本发明的数据内插装置,能够通过极简单的四则计算,获得在全域可作一次以上微分的有限级数的样本化函数,可以缩短获得没有低通滤波器的相位失真或舍位误差的良好的内插数据所需的运算时间,同时可以简化该运算电路。 | ||
| 搜索关键词: | 数据 内插 装置 方法 样本 函数 产生 程序 记录 媒体 | ||
【主权项】:
1.一种数据内插装置,其特征在于,具备:可使依次输入的分散数据依次延迟的多级延迟电路;以及,对从上述多级延迟电路的各输出级取出的各数据,进行对应数字基本函数的值的加权加法运算,由此求出对于上述依次输入的分散数据的内插数据的乘加法运算电路。
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