[发明专利]微处理机无效

专利信息
申请号: 02143924.9 申请日: 2002-09-28
公开(公告)号: CN1410876A 公开(公告)日: 2003-04-16
发明(设计)人: 桥本干生;藤本谦作;白川健治 申请(专利权)人: 株式会社东芝
主分类号: G06F5/00 分类号: G06F5/00;G06F15/00;H04L9/00
代理公司: 中国国际贸易促进委员会专利商标事务所 代理人: 罗亚川
地址: 日本*** 国省代码: 暂无信息
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摘要: 发明提供能够根据少量秘密,从OS高效率地保护密码化程序的内容的抗捣毁处理机。微处理机备有将识别符给予可以取多个状态的任务,与这些任务识别符对应地保持任务状态的任务状态表,保持现在执行中的任务识别符的任务寄存器,当存在任务要求时,将在用所定的程序键进行密码化的状态中存储在外部存储器中的程序读入超高速缓冲器线单位的接口,根据程序键产生对每条超高速缓冲器线不同的解码键,对读入的内容进行解码的密码处理部分,对于每条超高速缓冲器线将与用于这条超高速缓冲器线的解码的解码键对应的任务识别符保持在标签中的超高速缓冲存储器,和比较保持在超高速缓冲器线的标签中的任务识别符和任务寄存器的值,当值不一致时废弃超高速缓冲器线的内容的访问验证部分。
搜索关键词: 微处理机
【主权项】:
1.一种微处理机,它备有将识别符给予可以取多个状态的任务,与上述任务识别符对应地保持上述任务状态的任务状态表,保持现在执行中的任务识别符的任务寄存器,当存在上述任务要求时,将在用所定的程序键进行密码化的状态中存储在外部存储器中的程序读入超高速缓冲器线单位的接口,根据上述程序键,产生对每个上述超高速缓冲器线不同的解码键,对读入的内容进行解码的密码处理部分,由各条具有标签的多条超高速缓冲器线构成的,对于每条超高速缓冲器线,将与用于这条超高速缓冲器线的解码的解码键对应的任务识别符保持在上述标签中的第1超高速缓冲存储器,和比较保持在上述超高速缓冲器线的标签中的任务识别符和上述任务寄存器的值,当值不一致时废弃上述超高速缓冲器线的内容的访问验证部分。
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