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[发明专利]用于处理有限自动机的引擎架构-CN201410432318.7有效
发明人： R·戈亚尔;S·L·比拉;Y·沙纳瓦;G·A·鲍查德;T·T·纳卡达 -专利权人：凯为有限责任公司
申请日： 2014-08-28 - 公布日： 2019-03-01 - 主分类号： G06F13/28 文献下载
摘要：一种用于处理有限自动机的引擎架构包括一个专用于非确定有限自动机(NFA)处理的超非确定有限自动机(HNA)处理器。该HNA处理器包括多个超级集群和一个HNA调度器。每个超级集群包括多个集群。该多个集群中的每个集群包括多个HNA处理单元(HPU)。所选择的该至少一个超级集群的相应多个集群的相应多个HPU作为HPU资源池对用于对指示一个HNA指令进行分配的HNA调度器是可用的，以能够实现从网络接收到的输入流中的至少一个正则表达式的匹配的加速。
用于处理有限自动机引擎架构

[发明专利]用于在处理器中调度规则匹配的调度方法和装置-CN201410097575.X有效
发明人： J·A·庞伯恩;N·I·安萨里;G·A·鲍查德;R·戈亚尔 -专利权人：凯为公司
申请日： 2014-03-14 - 公布日： 2017-04-12 - 主分类号： G06F9/50 文献下载
摘要：在被配置为处理路由器中的搜索请求的网络搜索处理器中，用于调度通过多个启动引擎所启动的规则匹配线程的调度器被设计以有效地利用网络搜索处理器中的资源，同时提供高速性能。根据至少一个示例实施例，调度器及其相应的调度方法包括确定规则匹配线程组束，每个束通过独立的处理引擎被启动；将在束组的每个束中的规则匹配线程分布成多个规则匹配线程子组；将与束组的每个束相关联的规则匹配线程的子组分配给多个调度队列；以及根据基于与相应的规则匹配线程束相关联的优先级的顺序将被分配给每个调度队列的规则匹配线程发送给规则匹配引擎。
用于处理器调度规则匹配方法装置

[发明专利]跨多个内存口使用选择性复制降低内存访问延迟的系统及方法-CN201280057867.X有效
发明人： J·潘伯恩;G·A·鲍查德;R·戈亚尔;R·E·凯斯勒 -专利权人：凯为公司
申请日： 2012-09-26 - 公布日： 2014-07-30 - 主分类号： G06F12/02 文献下载
摘要：在一个实施例中，一种系统包括多个内存口(608A-608D)。这些内存口分布于多个子集中，其中每一个子集由一个子集索引标识并且这些内存口各自具有一个基于对应工作负载的单独等待时间。该系统进一步包括一个第一地址散列单元(602B)，该第一地址散列单元被配置成用于接收一个包括一个虚拟内存地址的读取请求。该虚拟内存地址与一个复制因子相关联，并且该虚拟内存地址指的是图形数据。该第一地址散列单元将该复制因子转化成一个基于该虚拟内存地址的相应子集索引，并且将该虚拟内存地址转换成一个基于硬件的内存地址。该基于硬件的地址指的是该相应子集索引所指示的一个子集内的这些内存口中的图形数据。该系统进一步包括一个内存复制控制器(604)，该内存复制控制器被配置成用于将对于该基于硬件的地址的读取请求指向该相应子集索引所指示的该子集内这些内存口中具有最低单独等待时间的一个。
跨多个内存使用选择性复制降低访问延迟系统方法