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专利名称

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申请人
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农业化学；冶金建筑机械工程区域搜索

主分类

B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]具有第一和第二字线的多端口SRAM电路-CN201580049316.2有效
发明人：詹特星·林;保罗·巴塞特;苏雷什·文库马洪蒂 -专利权人：高通股份有限公司
申请日： 2015-09-11 - 公布日： 2019-05-28 - 主分类号： G11C8/16 文献下载
摘要：一种位于静态随机存取存储器SRAM装置中的多端口混合型全摆幅/低摆幅存储器电路包括：第一字线驱动器，所述第一字线驱动器包括读取字线驱动器；第二字线驱动器，所述第二字线驱动器包括读取字线驱动器抑或读取/写入字线驱动器；存储器单元，所述存储器单元耦合到所述第一和第二字线驱动器；读出放大器，所述读出放大器耦合到所述存储器单元；以及锁存器，所述锁存器耦合到所述存储器单元。所述存储器电路能够达成高速低摆幅或低速全摆幅操作，同时避免对于集成电路上的大电路面积的需要。
具有第一第二多端 sram 电路

[发明专利]用于管线式处理的寄存器堆系统和方法-CN201310122677.8有效
发明人：王林;马苏德·卡迈;保罗·巴塞特;苏雷什·文库马洪蒂;沈剑 -专利权人：高通股份有限公司
申请日： 2008-09-12 - 公布日： 2013-07-31 - 主分类号： G06F9/38 文献下载
摘要：本发明公开了用于管线式处理的寄存器堆系统和方法。本发明包含一种多线程处理器，其包含与第一线程相关联的第一寄存器堆以及与第二线程相关联的第二寄存器堆。至少一个硬件资源由所述第一和第二寄存器堆共享。另外，所述第一线程可具有不与所述第二线程连续的管线存取位置。本发明还揭示一种存取多个寄存器堆的方法。所述方法包含从第一寄存器堆读取数据，同时从第二寄存器堆读取数据。所述第一寄存器堆与第一指令流相关联，且所述第二寄存器堆与第二指令流相关联。在处理器的执行管线中，所述第一指令流与所述第二指令流是连续的，且所述第一寄存器堆相对于所述第二寄存器堆在非邻近位置中。
用于管线处理寄存器系统方法

[发明专利]使用N路高速缓冲存储器的系统和方法-CN201210223636.3有效
发明人： 苏雷什·文库马洪蒂;菲利普·M·琼斯 -专利权人：高通股份有限公司
申请日： 2008-09-10 - 公布日： 2013-02-20 - 主分类号： G06F12/08 文献下载
摘要：本发明揭示一种使用n路高速缓冲存储器的系统和方法。在一实施例中，一种方法包含确定存储在高速缓冲存储器中的第一指令的第一路，且将所述第一路存储在路列表中。所述方法还包含确定存储在所述高速缓冲存储器中的第二指令的第二路，且将所述第二路存储在所述路列表中。在一实施例中，所述第一路可用于存取含有所述第一指令的第一高速缓冲存储器线，且所述第二路可用于存取含有所述第二指令的第二高速缓冲存储器线。
使用高速缓冲存储器系统方法

[发明专利]在多级数据处理管线中执行指令的系统和方法-CN200880111057.1有效
发明人：阿贾伊·阿南塔·英格尔;卢奇安·科德雷斯库;苏雷什·文库马洪蒂 -专利权人：高通股份有限公司
申请日： 2008-09-04 - 公布日： 2010-09-01 - 主分类号： G06F9/38 文献下载
摘要：本发明揭示一种装置，其包含具有用于执行指令的多个级的指令执行管线。所述装置还包含耦合到所述指令执行管线的控制逻辑电路。所述控制逻辑电路适于在指令执行期间跳过所述指令执行管线的至少一个级。所述控制逻辑电路还适于在经解码指令的执行期间执行至少一个非跳过的级。
多级数据处理管线执行指令系统方法

[发明专利]用于管线式处理的寄存器堆系统和方法-CN200880109732.7有效
发明人：王林;马苏德·卡迈;保罗·巴塞特;苏雷什·文库马洪蒂;沈剑 -专利权人：高通股份有限公司
申请日： 2008-09-12 - 公布日： 2010-08-18 - 主分类号： G06F9/38 文献下载
摘要：本发明包含一种多线程处理器，其包含与第一线程相关联的第一寄存器堆以及与第二线程相关联的第二寄存器堆。至少一个硬件资源由所述第一和第二寄存器堆共享。另外，所述第一线程可具有不与所述第二线程连续的管线存取位置。本发明还揭示一种存取多个寄存器堆的方法。所述方法包含从第一寄存器堆读取数据，同时从第二寄存器堆读取数据。所述第一寄存器堆与第一指令流相关联，且所述第二寄存器堆与第二指令流相关联。在处理器的执行管线中，所述第一指令流与所述第二指令流是连续的，且所述第一寄存器堆相对于所述第二寄存器堆在非邻近位置中。
用于管线处理寄存器系统方法

[发明专利]使用N路高速缓冲存储器的系统和方法-CN200880109441.8无效
发明人： 苏雷什·文库马洪蒂;菲利普·M·琼斯 -专利权人：高通股份有限公司
申请日： 2008-09-10 - 公布日： 2010-08-18 - 主分类号： G06F12/08 文献下载
摘要：本发明揭示一种使用n路高速缓冲存储器的系统和方法。在一实施例中，一种方法包含确定存储在高速缓冲存储器中的第一指令的第一路，且将所述第一路存储在路列表中。所述方法还包含确定存储在所述高速缓冲存储器中的第二指令的第二路，且将所述第二路存储在所述路列表中。在一实施例中，所述第一路可用于存取含有所述第一指令的第一高速缓冲存储器线，且所述第二路可用于存取含有所述第二指令的第二高速缓冲存储器线。
使用高速缓冲存储器系统方法

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