专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]除以整数常数的浮点除法-CN202311153353.0在审
  • 乔纳斯·卡伦;山姆·艾略特 - 畅想科技有限公司
  • 2019-08-21 - 2023-10-27 - G06F7/535
  • 一种用于确定比率x/d的二进制逻辑电路,其中x是可变整数输入,所述二进制逻辑电路包括:模数单元的对数树,每个模数单元都被配置为对于x中的相应块位置a和b来计算x[a:b]mod d,其中b>a,块位置的编号从x的最高有效比特增大到x的最低有效比特,所述模数单元被布置为使得所述对数树的M‑1个模数单元的子集为所有m∈{1,M}提供x[0:m]mod d,并且,基于任何给定的模数单元都会引入1的延迟:所有所述模数单元都在#imgabs0#的延迟包络内布置在所述对数树中;并且,模数单元的所述子集的超过M‑2u以最大延迟#imgabs1#布置,其中2u是恰好小于M的2的幂。
  • 除以整数常数浮点除法
  • [发明专利]除以整数常数的浮点除法-CN201910774064.X有效
  • 乔纳斯·卡伦;山姆·艾略特 - 畅想科技有限公司
  • 2019-08-21 - 2023-09-29 - G06F7/535
  • 一种用于确定比率x/d的二进制逻辑电路,其中x是可变整数输入,所述二进制逻辑电路包括:模数单元的对数树,每个模数单元都被配置为对于x中的相应块位置a和b来计算x[a:b]mod d,其中ba,块位置的编号从x的最高有效比特增大到x的最低有效比特,所述模数单元被布置为使得所述对数树的M‑1个模数单元的子集为所有m∈{1,M}提供x[0:m]mod d,并且,基于任何给定的模数单元都会引入1的延迟:所有所述模数单元都在#imgabs0#的延迟包络内布置在所述对数树中;并且,模数单元的所述子集的超过M‑2u以最大延迟#imgabs1#布置,其中2u是恰好小于M的2的幂。
  • 除以整数常数浮点除法

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