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[发明专利]用于管理高速缓存存储器的方法和系统-CN201310246644.4有效
发明人：胡晓宇;R·哈斯;I·科尔特西达斯;R·普莱特卡;P·H·明奇;S·L·布林尼克;Y-C·苏;E·S·埃莱夫特里乌;L·Y·邱 -专利权人：国际商业机器公司
申请日： 2013-06-20 - 公布日： 2014-01-15 - 主分类号： G06F3/06 文献下载
摘要：本发明涉及用于管理高速缓存存储器的方法、系统及其部件。该方法包括：提供包括共享的数据存储系统和若干本地服务器的计算机化的系统；从本地服务器中的每个本地服务器向共享的数据存储系统提供高速缓存数据信息，提供的高速缓存数据信息包括高速缓存命中数据和高速缓存未命中数据；在共享的数据存储系统处将接收的高速缓存未命中数据和高速缓存命中数据的至少部分聚合到聚合的高速缓存数据信息，并且向本地服务器中的一个或者多个本地服务器提供聚合的高速缓存数据信息；以及在本地服务器中的所述一个或者多个本地服务器处基于提供的聚合的高速缓存数据信息更新用来服务相应一个或者多个应用的相应一个或者多个高速缓存存储器
用于管理高速缓存存储器方法系统

[发明专利]对无依赖性并行区优化的直写式高速缓存及性能改进方法-CN201210029541.8有效
发明人： A·E·艾臣博格;A·加拉;M·欧玛克特;V·斯里尼发桑 -专利权人：国际商业机器公司
申请日： 2012-02-10 - 公布日： 2012-09-19 - 主分类号： G06F12/08 文献下载
摘要：与第一处理器的第一本地高速缓存存储器设备相关联的第一硬件本地高速缓存控制器检测由运行程序代码的第二处理器对第一高速缓存线的伪共享的发生，并且允许该第二处理器对所述第一高速缓存线的伪共享。当第一硬件本地高速缓存控制器更新第一本地高速缓存存储器设备中的第一高速缓存线的第一部分且第二硬件本地高速缓存控制器随后更新第二本地高速缓存存储器设备中的所述第一高速缓存线的第二部分时，发生对所述第一高速缓存线的伪共享
依赖性并行优化直写式高速缓存性能改进方法

[发明专利]高效高速缓存管理-CN201110415234.9有效
发明人： B-M·赫西;A·M·罗杰斯 -专利权人：微软公司
申请日： 2011-12-02 - 公布日： 2012-07-11 - 主分类号： G06F12/08 文献下载
摘要：一种管理计算设备的存储器的方法，包括提供可被分配为高速缓存存储器或可由计算设备组件使用的第一存储器。响应于高速缓存未中，第一存储器段可被分配为高速缓存存储器。通过响应于后续的高速缓存未中将额外的第一存储器段分配为高速缓存存储器，可动态地增大高速缓存大小。通过重新分配第一存储器高速缓存段以供计算设备组件使用，可动态地减小高速缓存存储器大小。高速缓存存储器可以是计算设备可访问的第二存储器的高速缓存。计算设备可以是移动设备。第一存储器可以是嵌入式存储器，第二存储器可包括嵌入式、可移动或外部存储器，或其任意组合。高速缓存存储器的最大大小随第一存储器的大小缩放。
高效高速缓存管理

[发明专利]处理器及其上实现的方法-CN201580064745.7有效
发明人： R·王;A·J·赫德里奇;Y-C·刘;H·H·胡姆;J·S·帕克;C·J·休斯;N·N·文凯特桑;A·C·莫加;A·贾里尔;Z·A·奇什蒂;M·A·埃尔金;J-S·蔡;A·W·民;T-Y·C·泰;C·马乔科;R·桑卡兰 -专利权人：英特尔公司
申请日： 2015-12-18 - 公布日： 2021-06-08 - 主分类号： G06F12/0842 文献下载
摘要：该装置包括具有多级高速缓存层次结构的多核处理器，该多级高速缓存层次结构包括用于每个核心的L1和L2高速缓存和共享的最后一级高速缓存(LLC)。提供了一个或多个机器级指令，以用于主动地将高速缓存行从较低级别高速缓存级别降级到较高级别高速缓存级别，包括将高速缓存行从L1/L2高速缓存降级到LLC。还提供了用于在多插槽的NUMA架构系统中实现硬件/软件协同优化的技术，其中高速缓存行可以选择性地被降级并且被推送到远程插槽中的LLC。另外，技术被公开以用于在多插槽的系统中实现早期监听，从而在存取远程插槽上的高速缓存行时减少延迟。
处理器及其实现方法

[发明专利]用于操作高速缓存存储设备以高速缓存与存储器地址相关联的数据的技术-CN202211433321.1在审
发明人：格雷姆·莱斯利·因格拉姆;迈克尔·安德鲁·坎贝尔 -专利权人： ARM有限公司
申请日： 2022-11-16 - 公布日： 2023-05-23 - 主分类号： G06F12/0871 文献下载
摘要：本技术提供了一种用于高速缓存数据的装置和方法。该装置具有：用于高速缓存与存储器地址相关联的数据的高速缓存存储设备；用于接收访问请求的第一接口，其中每个访问请求是访问该访问请求指示的存储器地址处的数据的请求；以及用于耦合到用于控制对存储器的访问的存储器控制器的第二接口此外，高速缓存控制电路用于根据基于功耗的分配策略来控制将数据分配到该高速缓存存储设备中，该分配策略寻求选择哪个数据被高速缓存在该高速缓存存储设备中，目的是节省与经由该第二接口对该存储器的访问相关联的功率为该高速缓存控制电路考虑的给定访问请求提供关联高速缓存提示信息，该提示信息为该给定访问请求指示的存储器地址处的给定数据提供一个或多个使用指示，并且该高速缓存控制电路被布置为在应用该基于功耗的分配策略以确定是否在该高速缓存存储设备中高速缓存该给定数据时参考该关联高速缓存提示信息
用于操作高速缓存存储设备存储器地址相关数据技术

[发明专利]基于价值的高速缓存方法和系统-CN03127560.5无效
发明人：爱德华·G·布里顿;沃斯雷·M·德文;拉普·T·会恩;巴拉·拉贾拉曼;阿瑟·J·斯塔格 -专利权人：国际商业机器公司
申请日： 2003-08-07 - 公布日： 2004-03-31 - 主分类号： G06F12/08 文献下载
摘要：基于价值的高速缓存系统和方法。基于价值的高速缓存方法可以包括将高速缓冲区分割为不同的基于价值的分区。可以评价存储在高速缓冲区中的数据的价值，价值高的数据可以被高速缓存在基于价值的分区的单独的分区中。随后，可以从基于价值的分区中清除高速缓存项。最后，可以根据评价步骤管理高速缓存和清除。在这点上，高速缓存和清除管理步骤可以确保对于相对于其他有价值的数据价值更高的数据拥有更快的高速缓存响应时间。
基于价值高速缓存方法系统

[发明专利]用于高速缓存控制操作的指令和逻辑-CN201680063732.2有效
发明人： R·萨桑卡 -专利权人：英特尔公司
申请日： 2016-09-28 - 公布日： 2022-10-04 - 主分类号： G06F12/0811 文献下载
摘要：在一个实施例中，处理器包括：取出逻辑，用于取出指令；解码逻辑，用于解码指令；高速缓存存储器；以及控制逻辑，用于接收高速缓存过滤指令，并且响应于高速缓存过滤指令，仅使存储器地址空间的选择的部分有资格被高速缓存在高速缓存存储器中高速缓存过滤指令可以指示存储器地址空间的选择的部分。描述了并要求保护其他实施例。
用于高速缓存控制操作指令逻辑

[发明专利]一种高速缓存管理方法、装置、系统、设备及介质-CN202210856082.4有效
发明人：崔健;王江;李树青;李幸远;巨新刚;吴睿振 -专利权人：苏州浪潮智能科技有限公司
申请日： 2022-07-21 - 公布日： 2022-12-09 - 主分类号： G06F12/0877 文献下载
摘要：本发明涉及缓存管理领域，公开了一种高速缓存管理方法、装置、系统、设备及介质，包括：存储系统高速缓存管理器接收目标用户发送的目标操作请求，通过流水线方式处理目标操作请求，以便利用目标操作请求对缓存行执行对应的处理操作；将目标操作请求的处理结果反馈至目标用户，并通过软件高速缓存管理器根据处理结果执行对应的高速缓存维护操作。可见，在本方案中，针对实时性要求较低的高速缓存维护操作，可通过软件高速缓存管理器实现，针对实时性要求较高的操作请求，可通过存储系统高速缓存管理器以流水线方式并行处理，降低缓存行操作的处理延迟，提高高速缓存管理的实时性
一种高速缓存管理方法装置系统设备介质

[发明专利]运算处理装置和高速缓存操作方法-CN200610159908.2无效
发明人：挂田雅英;中岛雅逸;山本崇夫;尾崎伸治 -专利权人：松下电器产业株式会社
申请日： 2006-09-27 - 公布日： 2007-04-25 - 主分类号： G06F12/08 文献下载
摘要：本发明提供一种运算处理装置和高速缓存操作方法。在多处理器结构的运算处理装置中，用作单处理器时避免高速缓存命中率下降。高速缓存访问传输单元(132)将经由本地高速缓存访问地址输入单元(161)从CPU(110)得到的访问地址，经由远程高速缓存访问地址输出单元(164)输出到公共地址总线(81)。高速缓存访问控制单元(231)使用从公共地址总线(81)经由远程高速缓存访问地址输入单元(265)得到的访问地址，进行对高速缓冲存储器(221)的访问。即，从处理器(100)的CPU(110)输出的访问地址从高速缓存访问传输单元(132)输出，通过高速缓存访问控制单元(231)取得，可用于对处理器(200)的高速缓冲存储器(221)的访问。
运算处理装置高速缓存操作方法

[发明专利]高速缓存存储器及包含其的存储系统及其操作方法-CN201911265732.2在审
发明人：郑承奎 -专利权人：爱思开海力士有限公司
申请日： 2019-12-11 - 公布日： 2020-09-29 - 主分类号： G06F12/0893 文献下载
摘要：高速缓存存储器包括：对应于偶地址的第一高速缓存区域；和对应于奇地址的第二高速缓存区域，其中第一高速缓存区域和第二高速缓存区域中的每一个包括多个高速缓存组，并且每个高速缓存组包括：数据组字段，其适用于储存与偶地址和奇地址之中的地址相对应的数据
高速缓存存储器包含存储系统及其操作方法

[发明专利]节能高速缓存及其运行方法-CN200410084015.7有效
发明人： E·B·科恩;T·E·库克;I·R·戈维特;P·D·卡尔特绍科;S·V·科索诺基;P·A·桑登;K·R·威廉姆斯 -专利权人：国际商业机器公司
申请日： 2004-10-13 - 公布日： 2005-05-04 - 主分类号： G06F12/08 文献下载
摘要：一种节能高速缓存及其运行方法。节能高速缓存包括动态减小高速缓存的逻辑大小以节能的电路。优选使用利用各种可组合硬件和软件技术的方法确定用于平衡功率和性能的最佳高速缓存的大小。另外，在优选实施例中，使用了在调整高速缓存大小时保持一致性的步骤，包括对高速缓存中修改(“脏”)的数据的处理，并提供了在调整大小时在几路的一路中分区高速缓存的步骤，以提供合适的配置和粒度。
节能高速缓存及其运行方法

[发明专利]包含用于支持每周期多次存取的高速缓存存储器的微处理器-CN200380104301.9有效
发明人： M·阿尔叙 -专利权人：先进微装置公司
申请日： 2003-11-06 - 公布日： 2006-01-04 - 主分类号： G06F12/08 文献下载
摘要：微处理器(100)包含用于支持每周多次存取的第二级高速缓存存储器(200)。微处理器(100)包含连接到高速缓存存储器子系统的执行单元(124)，此子系统包含连接到多个总线(240)的高速缓存存储器(200)。高速缓存存储器(200)包含多个可独立存取的存储块(220)。这些总线(240)连结每个存储块(220)以便传送多个高速缓存存取请求。响应多个高速缓存总线(240)中传送的多个高速缓存存取请求，同时存取不同的存储块(220)。
包含用于支持周期多次存取高速缓存存储器微处理器

[发明专利]依赖于指令类型的可配置高速缓存系统-CN200680017950.9无效
发明人： T·M·特朗;R·A·小咖瑞贝;M·S·希那扣达;P·K·米勒 -专利权人：德克萨斯仪器股份有限公司
申请日： 2006-05-24 - 公布日： 2008-05-14 - 主分类号： G06F12/00 文献下载
摘要：处理器(51)包括确定取出的每条指令的指令类型的译码逻辑(54)、一级高速缓存(L1)、耦合到一级高速缓存的二级高速缓存(L2)和操作地耦合到一级和二级高速缓存的控制逻辑。当高速缓存错过第一类型指令时，所述控制逻辑优选地导致对一级高速缓存执行线填充，但对于第二类型指令，控制逻辑阻止对一级高速缓存执行线填充。
依赖于指令类型配置高速缓存系统

[发明专利]高速缓存中上下文标识符的使用-CN03800522.0无效
发明人：佩尔·哈马隆德;K.S.·文卡特拉曼;阿拉温·巴克萨;迈克尔·厄普顿 -专利权人：英特尔公司
申请日： 2003-03-13 - 公布日： 2004-12-01 - 主分类号： G06F12/08 文献下载
摘要：在本发明中，在高速缓存装置中使用了上下文标识符。在高速缓存写操作期间，上下文标识符可被写入到高速缓存线的标签中，或者可作为高速缓存线标签的附加信息而被写入。在高速缓存读操作期间，可以将已发射的指令的上下文标识符与高速缓存线的标签中的上下文标识符进行比较。如果所述上下文标识符和所述标签都匹配，则可传输该高速缓存线的数据块。
高速缓存中上下文标识符使用

[发明专利]适配器存储系统和方法-CN202210208609.2在审
发明人：马克·佩戈洛蒂;肯尼·吴;拉维·社诺伊;格雷戈里奥·小杰尔瓦西奥;拉利特·查布拉;马克·卡尔诺夫斯基;詹姆斯·温斯顿·斯马特;沃昂·曹·阮 -专利权人：安华高科技股份有限公司
申请日： 2022-03-04 - 公布日： 2022-10-21 - 主分类号： H04L67/568 文献下载
摘要：所述总线适配器包含上下文存储器，所述上下文存储器包括用于不可高速缓存的互换资源指示符XRI的第一存储装置和用于可高速缓存的XRI的第二存储装置。所述总线适配器还包含主机支持存储单元，所述主机支持存储单元经配置以基于输入/输出阶段、先入直到限制、与所述可高速缓存的XRI指示符相关联的虚拟上下文地址的区域、与所述可高速缓存的XRI相关联的协议、事务的大小或工作队列信息中的至少一者来使用若干高速缓存子单元并以对所述可高速缓存的XRI进行任选固定操作的能力来提供对本地存在或在主机存储器扩展中外部存在的不同层级存储器的存取。
适配器存储系统方法