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- [发明专利]快闪存储器存取电路-CN200780030119.1无效
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V·M·G·范阿克特;N·拉姆伯特
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皇家飞利浦电子股份有限公司
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2007-08-13
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2009-08-05
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G06F9/44
- 一种包括指令处理器(10)、快闪存储器设备(14a)、快闪控制电路(14)和工作存储器(16)的系统。使中断程序的指令保持被存储在快闪存储器设备(14a)中。当指令处理器(10)接收到中断信号时，指令处理器(10)执行装入指令，以引起快闪控制电路(14)从快闪存储器设备(14a)中装入中断程序的所述指令到工作存储器(16)中。随后利用指令处理器(10)执行来自工作存储器(16)的中断程序的指令。优选地，在中断发生时，测试中断程序的所述指令的拷贝是否被存储在工作存储器(16)中。如果发现拷贝被存储，则在完成中断发生时正在进行的存取指令的执行之前，开始执行来自该拷贝的所述指令。如果未发现拷贝被存储，则首先完成存取指令的执行，并且随后指令处理器(10)执行装入指令，接着执行来自工作存储器(16)的中断程序的拷贝的指令。
- 闪存存取电路
- [发明专利]多处理器系统-CN00811299.1无效
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J·哈斯林格
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西门子公司
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2000-08-02
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2002-09-11
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G06F15/173
- 由n个数目处理器和属于这些处理器的共同的工作存储器以及具有使处理器在工作存储器上存取成为可能的总线系统构成的多处理器系统,在其中工作存储器(CMY)是各自经过一个双向串联导线(l000...lpmr)与每个处理器其中可以将共同的工作存储器分布在r个数目的存储部件(CMYi0...CMYir)上,此时每个存储部件是经过一个双向串联导线与每个处理器(PR000...PROpm)相连的。
- 处理器系统
- [发明专利]不可预测的微处理器或微型计算机-CN98801025.9无效
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迈克尔·尤冈
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布尔CP8公司
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1998-06-25
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1999-11-10
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G06F1/00
- 本发明涉及一种不可预测的微处理器或微型计算机,它包括一个处理器(1),一个第一工作存储器(51),一个包括操作系统,一个主程序(P1)和一个第二程序(P2)的主存储器(6),其特征在于它还包括一个第二工作存储器(52);切换装置,它在程序运行期间切换使用两个工作存储器(51,52)中的一个作为工作存储器,同时保存其中的内容;这些切换装置包括至少一个寄存器组(54),用于存储在主存储器中的程序的运行的上下文,和一个用于工作存储器有效性的切换电路(53),以及与每个存储器(51,52,6)相关并由所述切换电器(53)所控制的访问寄存器(A1－A3)(D1－D3)。
- 不可预测微处理器微型计算机
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