[发明专利]异步时钟ADC电路的亚稳态的检测消除电路有效
| 申请号： | 201910558207.3 | 申请日： | 2019-06-25 |
| 公开（公告）号： | CN110401444B | 公开（公告）日： | 2023-04-07 |
| 发明（设计）人： | 张振伟;董业民;单毅 | 申请（专利权）人： | 中国科学院上海微系统与信息技术研究所 |
| 主分类号： | H03M1/10 | 分类号： | H03M1/10;H03M1/46 |
| 代理公司： | 上海智信专利代理有限公司 31002 | 代理人： | 邓琪 |
| 地址： | 200050 *** | 国省代码： | 上海;31 |
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| 摘要： | 本发明涉及一种异步时钟ADC电路的亚稳态的检测消除电路，包括：异步时钟生成电路，用于根据所述异步时钟ADC电路的比较器的输出和反向输出生成一异步时钟信号，作为所述异步时钟ADC电路的比较器的时钟信号输入至所述异步时钟ADC电路的比较器的时钟信号输入端；亚稳态标志信号生成电路，输出端连接至所述异步时钟生成电路，用于向所述异步时钟生成电路输出由所述异步时钟信号确定的亚稳态标志信号，使在所述异步时钟信号异常时，输出至所述异步时钟生成电路的亚稳态标志信号使得所述异步时钟生成电路输出的时钟信号恒为零，比较器复位。 | ||
| 搜索关键词： | 异步 时钟 adc 电路 亚稳态 检测 消除 | ||
【主权项】：
1.一种异步时钟ADC电路的亚稳态的检测消除电路，其特征在于，包括：异步时钟生成电路，用于根据所述异步时钟ADC电路的比较器的正向输出和反向输出生成一异步时钟信号，作为所述异步时钟ADC电路的比较器的时钟信号输入至所述异步时钟ADC电路的比较器的时钟信号输入端；亚稳态标志信号生成电路，输出端连接至所述异步时钟生成电路，用于向所述异步时钟生成电路输出由所述异步时钟信号确定的亚稳态标志信号，使在所述异步时钟信号异常时，输出至所述异步时钟生成电路的亚稳态标志信号使得所述异步时钟生成电路输出的时钟信号恒为零，并对所述比较器进行复位。
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