[发明专利]卷积运算装置及卷积神经网路的卷积输入的调规方法在审
| 申请号： | 201810243043.0 | 申请日： | 2018-03-23 |
| 公开（公告）号： | CN110163335A | 公开（公告）日： | 2019-08-23 |
| 发明（设计）人： | 杜力;杜源;苏俊杰;蒋明哲 | 申请（专利权）人： | 耐能股份有限公司 |
| 主分类号： | G06N3/04 | 分类号： | G06N3/04;G06N3/063 |
| 代理公司： | 北京纪凯知识产权代理有限公司 11245 | 代理人： | 赵志刚;赵蓉民 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 本发明涉及卷积运算装置及卷积神经网路的卷积输入的调规方法。一种卷积运算装置，包括卷积运算模块、存储器、规模控制模块以及调规器。卷积运算模块输出多个带小数部的卷积运算结果；存储器耦接卷积运算模块，接收并储存带小数部的卷积运算结果，以及输出多个带小数部的卷积运算输入值；规模控制模块耦接卷积运算模块，根据带小数部的卷积运算结果的整体规模产生调规信号；调规器耦接存储器、规模控制模块及卷积运算模块，根据调规信号调整带小数部的卷积运算输入值的规模，然后将调整规模后的带小数部的卷积运算输入值输出至卷积运算模块。 | ||
| 搜索关键词： | 卷积运算 卷积运算模块 小数 卷积 规模控制 神经网路 存储器 输出 存储器耦接 模块耦接 信号调整 整体规模 器耦 储存 | ||
【主权项】：
1.一种卷积运算装置，包括：卷积运算模块，输出多个带小数部的卷积运算结果；存储器，耦接该卷积运算模块，接收并储存所述带小数部的卷积运算结果，以及输出多个带小数部的卷积运算输入值；规模控制模块，耦接该卷积运算模块，根据所述带小数部的卷积运算结果的整体规模产生调规信号；以及调规器，耦接该存储器、该规模控制模块及该卷积运算模块，根据该调规信号调整所述带小数部的卷积运算输入值的规模，然后将调整规模后的所述带小数部的卷积运算输入值输出至该卷积运算模块。
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