[实用新型]一种基于ASAAC结构的多核网状高性能并行信号处理模块有效

专利信息
申请号: 201720990141.1 申请日: 2017-08-09
公开(公告)号: CN206948362U 公开(公告)日: 2018-01-30
发明(设计)人: 陈延强 申请(专利权)人: 国蓉科技有限公司
主分类号: H04L12/931 分类号: H04L12/931;H04L12/933;H04L12/02
代理公司: 成都君合集专利代理事务所(普通合伙)51228 代理人: 张鸣洁
地址: 610000 *** 国省代码: 四川;51
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摘要: 实用新型公开了一种基于ASAAC结构的多核网状高性能并行信号处理模块,包括信号处理母板,所述的信号处理母板包括多个能够独立运行的交换机、能够分别与多个交换机连接的母板FPGA、能够分别与多个交换机连接的母板DSP芯片、能够分别与多个交换机连接的LRM连接器;所述的母板DSP芯片能够与母板FPGA连接;所述的母板FPGA能够与LRM连接器连接。本实用新型的有益效果是本实用新型能够提供多核网状高性能并行处理模块,有利于增加处理的带宽以及并行处理的灵活性,能够根据具体的需要选择不同的多核处理器以满足不同的使用需求,从而增加了本实用新型的适用范围。
搜索关键词: 一种 基于 asaac 结构 多核 网状 性能 并行 信号 处理 模块
【主权项】:
一种基于ASAAC结构的多核网状高性能并行信号处理模块,其特征在于:包括一片主要由SRIO交换机、GBE交换机、两个母板DSP芯片、母板FPGA、LRM连接器组成的信号处理母板,作为对外的结构连接器的LRM连接器分别与母板FPGA、SRIO交换机、GBE交换机连接,用于扇出低速交换网络的GBE交换机与母板DSP芯片连接,同时用于扇出高速交换网络的SRIO交换机分别与互连的母板DSP芯片、母板FPGA连接。
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