[发明专利]乘法累加乘积指令

摘要

本公开涉及乘法累加乘积指令。本文提供了一种设备，该设备具有包括L×M乘法器阵列的处理电路。与处理电路相关联的指令解码器支持用于生成至少一个结果元素的乘法累加乘积(MAP)指令，该至少一个结果元素对应于J位操作数的E位部分和K位操作数的F位部分的相应E×F乘积的和，其中1

主权项

1.一种设备，包括：处理电路，所述处理电路用于执行数据处理，所述处理电路包括L×M乘法器阵列，其中L和M是整数；以及指令解码器，所述指令解码器响应于指定L位操作数和M位操作数的乘法指令来控制所述乘法器阵列使用用于累加所述L位操作数和所述M位操作数的部分乘积的多个加法器来将所述L位操作数和所述M位操作数相乘；其中响应于指定第一J位操作数和第二K位操作数的乘法累加乘积(MAP)指令，其中J≤L并且K≤M，所述指令解码器被配置用于控制所述处理电路来生成包括至少一个结果元素的结果值，每个结果元素对应于所述第一J位操作数的E位部分和所述第二K位操作数的F位部分的相应E×F乘积的和，其中1

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