[发明专利]一种NEXT系列产品的高速同步数据采集仪在审
申请号: | 201510563350.3 | 申请日: | 2015-09-07 |
公开(公告)号: | CN106502943A | 公开(公告)日: | 2017-03-15 |
发明(设计)人: | 徐云鹏 | 申请(专利权)人: | 江西恒盛晶微技术有限公司 |
主分类号: | G06F13/40 | 分类号: | G06F13/40;G06F13/42 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 330096 江西省南昌市高*** | 国省代码: | 江西;36 |
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摘要: | 本发明公开了一种NEXT系列产品的高速同步数据采集仪,该系统由输入信号预处理电路、输出信号预处理电路、同步A/D转换电路、同步D/A转换电路、FPGA主控芯片、CPCI控制总线、上位机构成,其中FPGA主控芯片包括FIFO模块和RAM模块;输入信号预处理电路及输出信号预处理电路分别与同步A/D转换电路和同步D/A转换电路连接,分别用于输入模拟信号的缓冲和输出模拟信号的滤波;同步A/D转换电路以及同步D/A转换电路同FPGA主控芯片之间采用I/O口连接,分别用于完成信号的模数转换以及模数转换;FPGA主控芯片作为系统的主控制器与CPCI控制总线之间通过PCI接口电路连接;上位机作为系统交互端与CPCI控制总线连接,同系统进行通讯;该发明可实现多通道同步数据的高速采集。 | ||
搜索关键词: | 一种 next 系列产品 高速 同步 数据 采集 | ||
【主权项】:
一种NEXT系列产品的高速同步数据采集仪,其特征在于该系统由输入信号预处理电路、输出信号预处理电路、同步A/D转换电路、同步D/A转换电路、FPGA主控芯片、CPCI控制总线、上位机构成,其中,FPGA主控芯片内部包括FIFO模块和RAM模块;模拟信号经输入信号预处理电路后输入到同步A/D转换电路完成对模拟信号的采样,转换出的数字信号在FPGA内部构建的FIFO模块中进行缓存,通过CPCI总线将FIFO中的数据传送到上位机中,实现数据的同步采集及传输,同样的,上位机通过CPCI总线将发送给D/A的信号数据传输给FPGA,存储在其内部构建的模块RAM模块中,FPGA控制RAM中的数据传输给同步D/A转换电路进行数字信号到模拟信号的转换,通过滤波和电压放大电路进行预处理,减小输出信号的干扰,实现电压信号的准确输出;输入信号预处理电路及输出信号预处理电路分别与同步A/D转换电路和同步D/A转换电路连接;同步A/D转换电路以及同步D/A转换电路同FPGA主控芯片之间采用I/O口与对应的模块进行连接;FPGA主控芯片与CPCI控制总线之间通过PCI接口电路双向连接;上位机与CPCI控制总线双向连接。
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