[实用新型]基于CPLD的变压器局部放电电-声信号同步监测装置有效

专利信息
申请号: 201320283635.8 申请日: 2013-05-22
公开(公告)号: CN203299333U 公开(公告)日: 2013-11-20
发明(设计)人: 韦善革;李雪;吴杰康;李啸骢 申请(专利权)人: 广西大学;柳州承特变压器有限公司
主分类号: G01R31/12 分类号: G01R31/12;G01H17/00
代理公司: 广西南宁汇博专利代理有限公司 45114 代理人: 邓晓安
地址: 530004 广西*** 国省代码: 广西;45
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摘要: 实用新型公开一种基于CPLD的变压器局部放电电-声信号同步监测装置,包括CPLD控制模块,以及分别与CPLD控制模块连接的传感器模块、信号调理模块、四通道同步采样ADC、解串器模块、FIFO存储器、PCI总线接口电路和上位计算机。该装置利用CPLD控制信号调理模块、四通道同步采样ADC和FIFO存储器,对变压器局部放电产生的多路电-声信号进行信号调理、同步A/D采样和数据暂存后,经PCI总线上传至上位计算机进行综合分析和处理,实现了对宽频的电-声信号的同步在线监测,可及时获得完整的局部放电信号特征,提高了监测的准确性,并且该装置可靠性高,抗干扰能力强、运行稳定。
搜索关键词: 基于 cpld 变压器 局部 放电 信号 同步 监测 装置
【主权项】:
一种基于CPLD的变压器局部放电电‑声信号同步监测装置,包括传感器模块(1)、信号调理模块(3)、四通道同步采样ADC(4)和上位计算机(8);其特征在于:该装置还包括CPLD控制模块(2)、解串器模块(5)、FIFO存储器(6)和PCI总线接口电路(7);根据信号的传输流向,所述的传感器模块(1)、信号调理模块(3)、四通道同步采样ADC(4)、解串器模块(5)、FIFO存储器(6)、PCI总线接口电路(7)和上位计算机(8)依次连接;所述的信号调理模块(3)、四通道同步采样ADC(4)、解串器模块(5)、FIFO存储器(6)和PCI总线接口电路(7)的控制端分别与CPLD控制模块(2)相连接,所述上位计算机(8)通过RS232总线与CPLD控制模块(2)相连接;所述的CPLD控制模块(2)分别控制信号调理模块(3)和四通道同步采样ADC(4),对传感器模块(1)采集到的变压器局部放电产生的脉冲电流信号和超声波信号进行预处理和同步A/D变换后,经解串器模块(5)将采样数据暂存在FIFO存储器(6)中,然后在CPLD控制模块(2)的控制下,将8位采样数据拼接成32位数据后,经32位的PCI总线接口电路(7)上传到上位计算机(8),在上位计算机(8)中对电‑声信号联合监测数据进行综合分析和处理,以判断变压器内是否存在局部放电现象,同时,所述上位计算机(8)通过RS232总线对CPLD控制模块(2)的工作状态进行监控与设置。
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