[发明专利]一种自适应PVT变化的时钟电路设计方法有效
| 申请号： | 201310400304.2 | 申请日： | 2013-09-04 |
| 公开（公告）号： | CN103500243A | 公开（公告）日： | 2014-01-08 |
| 发明（设计）人： | 温亨;石彦 | 申请（专利权）人： | 深圳市国微电子有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 深圳鼎合诚知识产权代理有限公司 44281 | 代理人： | 薛祥辉 |
| 地址： | 518057 广东省深圳市南*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种自适应PVT变化的时钟电路设计方法。本发明的时钟电路设计方法包括：在集成电路完成布局后确定同一时钟源驱动的存在时序关系的第一时序器件和第二时序器件，所述第一时序器件的数据输出被第二时序器件采样；确定待分析的PVT，以及确定在各PVT下第一时序器件与第二时序器件之间的数据路径最大延时；在第一时序器件和第二时序器件之间的时钟路径上插入或调整延时单元，使第一时序器件到第二时序器件的时钟偏差在各个PVT下大于所述数据路径最大延时。应用本发明方法设计的电路可以自适应PVT变化，避免了在非最差PVT下过大的性能冗余，从而提高了在非最差PVT下的电路性能。 | ||
| 搜索关键词： | 一种 自适应 pvt 变化 时钟 电路设计 方法 | ||
【主权项】：
一种自适应PVT变化的时钟电路设计方法，其特征在于，在集成电路完成布局后还包括以下步骤：确定同一时钟源驱动的存在时序关系的第一时序器件和第二时序器件，所述第一时序器件的输出被第二时序器件采样；确定多个待分析的PVT，并确定在各个PVT下，第一时序器件与第二时序器件之间的数据路径最大延时；在第一时序器件和第二时序器件之间的时钟路径上插入或调整延时单元，使第一时序器件到第二时序器件的时钟偏差在各个PVT下大于所述数据路径最大延时。
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