[发明专利]采用滚动输出模式的高速雷达视频显示处理方法有效
申请号: | 201310275964.2 | 申请日: | 2013-07-03 |
公开(公告)号: | CN103327269A | 公开(公告)日: | 2013-09-25 |
发明(设计)人: | 邢永昌;朱向云 | 申请(专利权)人: | 中国船舶重工集团公司第七二四研究所 |
主分类号: | H04N5/445 | 分类号: | H04N5/445;H04N7/01 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 210003 *** | 国省代码: | 江苏;32 |
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摘要: | 本发明涉及一种采用滚动输出模式的雷达视频输出显示处理方法。随着雷达重频和显示器显示分辨率的提高,当前VRAM的速度已经不能满足雷达视频的实时刷新要求了。本发明提出一种采用滚动输出模式的视频输出处理方法。其实现过程为:FPGA处理数据用的缓存采用具有高速读写特征的SRAM,首先针对每个雷达视频窗口设计两个FIFO存储器,每个存储器容量不小于1行视频的数据的容量;然后把处理完成的雷达视频根据SRAM可读时间片读出,分别写入两个FIFO;最后按照行扫速率从两个FIFO中读出雷达视频数据,与二次视频叠加后串行输出到显示器显示。通过实验验证,该方法在保证高数据率和高分辨率的前提下,实现了显示画面流畅实时刷新。 | ||
搜索关键词: | 采用 滚动 输出 模式 高速 雷达 视频 显示 处理 方法 | ||
【主权项】:
一种采用滚动输出模式实现雷达视频显示处理方法,其特征在于,包括如下步骤:1)采用具有高速读写特征的SRAM作为雷达视频的处理缓存;2)针对每个雷达视频显示窗口设计两个FIFO,每个FIFO的容量不小于存储1行雷达视频数据;3)以FPGA处理雷达视频的时序选择SRAM可读时间片把雷达视频数据滚动写入两个FIFO中;4)以显示器视频行输出频率,根据FIFO读写标志分别读取视频行输出雷达视频数据;5)把读取的各个相关视口对应行雷达视频数据,对接组合形成完整的雷达视频行;6)与二次视频的该行视频数据叠加,输出叠加后的综合视频到显示器;7)循环7)、4)、5)和6)步完成综合视频流的输出到显示器,并形成流畅的视频画面。
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