[发明专利]10G EPON报文的捕获电路及写控制方法有效

专利信息
申请号: 201210237703.7 申请日: 2012-07-11
公开(公告)号: CN102752674A 公开(公告)日: 2012-10-24
发明(设计)人: 鲁群;娄非志;姜涛 申请(专利权)人: 烽火通信科技股份有限公司
主分类号: H04Q11/00 分类号: H04Q11/00;H04L12/56
代理公司: 北京捷诚信通专利事务所(普通合伙) 11221 代理人: 魏殿绅;庞炳良
地址: 430074 湖北省武*** 国省代码: 湖北;42
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摘要: 发明公开了一种10G EPON报文的捕获电路及写控制方法,写控制方法的步骤:10G EPON OLT和ONU之间交互的EPON报文经光模块和10G SERDES接收,在PCS子层完成解码后根据设定条件组合触发报文捕获;将捕获的报文写入捕获缓存,捕获帧保存的步骤和格式为:在帧包络有效时的偶数时钟周期写入128bit帧数据;在帧尾后一个时钟周期写入本帧的帧头字节数、帧尾字节数、到达时间、本帧错误指示、CRC校验错误指示和帧分界符。本发明能高速精确地捕获和分析10G连续的EPON报文,通过特定触发或筛选条件减少捕获报文存储空间,提升远程调度器性能和使用效率,增强不同设备厂家间的互通能力。
搜索关键词: 10 epon 报文 捕获 电路 控制 方法
【主权项】:
一种10G EPON报文的捕获电路,其特征在于包括:bit位调整电路、与bit位调整电路相连的数据预分析模块、定时装置、分别与定时装置相连的触发点生成模块、描述先入先出缓存和CPU、分别与CPU相连的帧捕获使能生成模块、模式选择器和缓存读写控制模块、以及与帧捕获使能生成模块相连的数据先入先出缓存;触发点生成模块分别与数据预分析模块、描述先入先出缓存、CPU相连,触发点生成模块接收CPU下发的帧匹配规则;bit位调整电路与数据先入先出缓存相连,帧捕获使能生成模块分别与描述先入先出缓存、数据先入先出缓存、模式选择器相连;模式选择器与缓存读写控制模块相连;bit位调整电路还通过最简手动模式通道与模式选择器相连,最简手动模式通道还与定时装置相连,获得10G EPON报文到达捕获电路的时间。
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