[发明专利]设定记忆区块为系统程序区和数据缓冲区的电路及方法无效
| 申请号： | 201210065363.4 | 申请日： | 2012-03-13 |
| 公开（公告）号： | CN103186478A | 公开（公告）日： | 2013-07-03 |
| 发明（设计）人： | 萧友章;陈鼎允 | 申请（专利权）人： | 擎泰科技股份有限公司 |
| 主分类号： | G06F12/08 | 分类号： | G06F12/08 |
| 代理公司： | 深圳新创友知识产权代理有限公司 44223 | 代理人： | 江耀纯 |
| 地址： | 中国台*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 本发明公开了一种设定多个记忆区块为系统程序区和数据缓冲区的电路和方法。该方法包括产生多个选择信号；根据该多个选择信号，将该多个记忆区块中的部分记忆区块设定为该系统程序区的记忆区块，以及将该多个记忆区块中的其余记忆区块设定为该数据缓冲区的记忆区块。因此，本发明不仅可增加内存数组的使用者开发程序的弹性，亦可降低该内存数组因为该内存数组架构问题改版的机率。 | ||
| 搜索关键词： | 设定 记忆 区块 系统 程序 数据 缓冲区 电路 方法 | ||
【主权项】：
一种设定多个记忆区块为系统程序区和数据缓冲区的电路，该电路的特征在于包括：系统程序区位置译码单元，用以根据多个区块寻址信号及寻址选择信号，产生对应于该多个记忆区块的多个第一译码信号；数据缓冲区位置译码单元，用以根据该多个区块寻址信号及该寻址选择信号，产生对应于该多个记忆区块的多个第二译码信号；及区块选择单元，包括多个选择单元，其中每一个选择单元是对应该多个记忆区块中的一个记忆区块、该多个第一译码信号中的一个第一译码信号、多个选择信号中的一个选择信号和该多个第二译码信号中的一个第二译码信号，并根据该选择信号决定输出该第一译码信号或该第二译码信号，以致能该记忆区块。
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