[发明专利]在数字化变电站内合并单元中设置多时钟的方法及应用有效
| 申请号： | 201210009768.6 | 申请日： | 2012-01-12 |
| 公开（公告）号： | CN102546146A | 公开（公告）日： | 2012-07-04 |
| 发明（设计）人： | 竹之涵;蔡泽祥;黄毅;刘文泽;苏忠阳 | 申请（专利权）人： | 广州思唯奇计算机科技有限公司;华南理工大学 |
| 主分类号： | H04L7/00 | 分类号： | H04L7/00;H04L12/56;H02J13/00 |
| 代理公司： | 广州市华学知识产权代理有限公司 44245 | 代理人： | 罗观祥 |
| 地址： | 510000 广东省广州*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明为一种在数字化变电站内合并单元中设置多时钟的方法：在一个合并单元内部设置两个以上网卡，每个网卡设置一个IEEE1588时钟；所有网卡与CPU相互信号连接，所有网卡内的IEEE1588时钟通过CPU内的1588协议栈进行误差频率和Offset调节；在任意一网卡内：网卡的PHY接口连接以太网，晶振脉冲连接网卡的输入，PHY接口与报文识别器相互信号连接，报文识别器与MAC接口相互信号连接，网卡输出脉冲用于同步采样。该合并单元可应用在数字化变电站内，也可应用在数字化变电站间，可使数字化变电站间的不同时钟域实现采样值同步，从而提高纵差保护的灵敏度，对电力系统的稳定运行具有重要作用。 | ||
| 搜索关键词： | 数字化 变电 站内 合并 单元 设置 多时 方法 应用 | ||
【主权项】：
一种在数字化变电站内合并单元中设置多时钟的方法，其特征在于：在一个合并单元内部设置两个以上网卡，每个网卡内部设置一个IEEE1588时钟；所有网卡均与CPU相互信号连接，所有网卡内的IEEE1588时钟通过设置在CPU内的1588协议栈进行误差频率和Offset调节；在任意一个网卡内：网卡的PHY接口连接以太网，晶振脉冲连接网卡的输入以驱动网卡内的IEEE1588时钟，PHY接口与报文识别器相互信号连接，报文识别器与MAC接口相互信号连接，网卡输出脉冲用于同步采样。
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