[发明专利]数据处理装置无效

专利信息
申请号: 200710086378.8 申请日: 2007-03-15
公开(公告)号: CN101038580A 公开(公告)日: 2007-09-19
发明(设计)人: 白野康之 申请(专利权)人: 日本电气株式会社
主分类号: G06F15/177 分类号: G06F15/177;G06F1/04
代理公司: 中科专利商标代理有限责任公司 代理人: 朱进桂
地址: 日本*** 国省代码: 日本;JP
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摘要: 一种数据处理装置,包括多个CPU模块,每个CPU模块包括CPU。多个CPU模块中的每个包括时钟源、时钟计数器、I/O模块、第一数据加法器和计时调整器。第一数据加法器读取时钟计数器的值,将预定偏移值添加至读取值上以生成计时值,并将所生成的计时值添加至指定给CPU的分组上。计时调整器基于从第一数据加法器接收的分组的计时值和时钟计数器的值,来调整将分组发送至CPU的时间。
搜索关键词: 数据处理 装置
【主权项】:
1、一种数据处理装置,包括多个CPU模块,每个CPU模块都包括CPU,所述多个CPU模块通过交叉链路彼此连接;其中,所述多个CPU模块中的每个包括:时钟源,用于向自身的CPU提供时钟;时钟计数器,用于对来自时钟源的时钟进行计数;I/O模块,用于向CPU发送预定分组并从CPU接收预定分组;第一数据加法器,用于在从I/O模块接收到指定给CPU的分组时,读取时钟计数器的值,将预定偏移值添加至读取值上以生成计时值,并将所生成的计时值添加至指定给CPU的分组上;以及计时调整器,用于基于从第一数据加法器接收的分组的计时值和时钟计数器的值,来调整将分组发送至CPU的时间。
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