专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]基于QSPI的flash访问方法及应用-CN202111592124.X在审
  • 周磊;贾复山;丁兴仪 - 南京盛科通信有限公司
  • 2021-12-23 - 2023-06-27 - G06F13/12
  • 本发明公开了一种基于QSPI的flash访问方法及应用,该方法包括以下步骤:QSPI控制器识别CPU访问地址所属的访问空间类型,其中,所述访问空间类型包括XIP访问空间和IO访问空间;以及所述QSPI控制器根据所述访问空间类型,执行相应的flash访问模式。该方法能够通过在传统的QSPI控制接口中添加一个访问控制模块,在资源有限的情况下,通过划分地址空间的方式实现XIP和IO模式混合复用,只需要外接一片flash,就可以实现一个flash上既运行系统,又可以使flash作为数据存储器,完成系统和数据的交叉使用。
  • 基于qspiflash访问方法应用
  • [发明专利]报文处理方法、装置、电子设备及计算机可读存储介质-CN202310237832.4在审
  • 龚海东;方沛昱;贾复山 - 苏州盛科通信股份有限公司
  • 2023-03-13 - 2023-06-02 - H04L49/90
  • 本发明实施例提出一种报文处理方法、装置、电子设备及计算机可读存储介质,属于通信技术领域,网络设备在监测到外部设备开始发送业务报文的数据包时,在当前收包处于拥塞状态的情况下,将接收的数据包写入双倍速率同步动态随机存储器,在当前收包未处于拥塞状态的情况下,将接收的数据包中的报文头数据直接写入中央处理器的高速缓存中,将报文头数据之外的其他数据写入双倍速率同步动态随机存储器,从而使得中央处理器处理该业务报文时,报文头数据已经在高速缓存中,无需再去访问双倍速率同步动态随机存储器来获取报文头数据,能够有效减轻中央处理器对双倍速率同步动态随机存储器的访存压力,进而能够提升软转发的整体性能。
  • 报文处理方法装置电子设备计算机可读存储介质
  • [发明专利]一种报文处理方法、装置及电子设备-CN202310105083.X在审
  • 杨八双;贾复山;刘庆海 - 苏州盛科通信股份有限公司
  • 2023-02-13 - 2023-05-16 - H04L67/568
  • 本申请提出一种报文处理方法、装置及电子设备,包括:DMA控制器、目标缓存、第一存储器以及CPU,DMA控制器与目标缓存和第一存储器通信连接,CPU与目标缓存和第一存储器通信连接;DMA控制器用于在进行报文收包时,申请对应的第一类目标描述符;DMA控制器用于确定第一类目标描述符是否满足写入目标缓存的条件;若是,DMA控制器还用于将第一类目标描述符对应的目标数据写入目标缓存;若否,DMA控制器还用于将第一类目标描述符对应的目标数据写入第一存储器;CPU用于基于目标缓存中存储的目标数据完成收包处理。CPU可以不去访问第一存储器,可以避免CPU访问第一存储器带来的延迟,从而可以提升报文处理的效率。
  • 一种报文处理方法装置电子设备
  • [发明专利]一种报文处理方法及装置-CN202310028982.4在审
  • 龚海东;贾复山;杨八双;王俊杰 - 苏州盛科通信股份有限公司
  • 2023-01-09 - 2023-04-28 - H04L49/90
  • 本申请提出一种报文处理方法及装置,包括:在信息收发模块接收到报文包时,若收包队列处于非拥挤状态,信息收发模块将报文包的报文头写入第一目标地址段,将报文包的报文主体写入第二目标地址段;信息收发模块将第一地址信息和第二地址信息写入第一目标收包描述符;信息收发模块将第一目标收包描述符标记为占用状态;处理器在按照预设顺序对处于占用状态的收包描述符所对应的报文头进行处理后,基于收包描述符对应的第一地址信息和第二地址信息更新发包队列,以完成报文转发。处理器访问第一存储器的时延小于处理器访问第二存储器的时延。可以降低处理器的访存时延,进而提升整体的转发效率。
  • 一种报文处理方法装置
  • [发明专利]一种流量处理系统及方法-CN202211735154.6在审
  • 耿磊;赵金玺;贾复山 - 南京盛科通信有限公司
  • 2022-12-30 - 2023-04-18 - H04L49/90
  • 本发明的实施例提供了一种流量处理系统及方法,涉及通信领域,接收模块对数据接收,片内缓存模块将数据存储,队列编号产生模块为数据产生队列编号,将数据发往对应的队列中,基于确定发往各队列的描述符信息的数量与该队列对应的长度阈值,将超过长度阈值的描述符信息添加至DMA队列中,队列调度模块基于调度规则对不同队列中的描述符信息进行调度,数据输出模块接收描述符信息,基于描述符信息从片内缓存模块中获取对应的待处理数据,将待处理数据输出,外挂大容量缓存颗粒用于将DMA队列中描述符信息对应的数据进行暂存。避免在发生突发流量时,对数据进行丢包。
  • 一种流量处理系统方法
  • [发明专利]数据处理方法及相关装置-CN202211729886.4在审
  • 贾复山;杨八双;孙文瀚 - 苏州盛科通信股份有限公司
  • 2022-12-30 - 2023-04-18 - G06F13/16
  • 本申请实施例提出一种数据处理方法及相关装置,涉及嵌入式系统领域。根据待处理数据的数据大小以及数据类型,确定高速缓冲存储器是否满足预设的数据存储条件;待处理数据包括外部数据和/或存储在大容量动态随机存储器的存储数据;若高速缓冲存储器满足预设的数据存储条件,则将待处理数据存储至高速缓冲存储器中,以便CPU从高速缓冲存储器中获取待处理数据,并对待处理数据进行数据处理;若高速缓冲存储器不满足预设的数据存储条件,则将待处理数据存储至大容量动态随机存储器中。通过该方法可提高CPU获取数据的效率,从而提高嵌入式系统的性能。
  • 数据处理方法相关装置
  • [发明专利]一种基于Soc芯片的数据加解密方法和装置-CN202211717715.X在审
  • 龚海东;姚飞;贾复山 - 苏州盛科通信股份有限公司
  • 2022-12-29 - 2023-04-04 - H04L9/40
  • 本发明公开了一种基于Soc芯片的数据加解密方法和装置,属于网络通信技术领域。方法包括芯片端口的入方向收到报文,解析后将需要解密处理的报文通过随路解密通道发送至加解密引擎进行解密处理,并将解密后的报文信息上送至CPU;CPU查找报文信息并确定加解密参数,将需要旁路加解密处理的报文通过旁路加解密通路送入加解密引擎进行加解密处理,并将加解密处理后的报文信息上送至CPU;CPU根据报文信息确定随路加密参数,将需要随路加密处理的报文通过随路加密通道下发至随路报文加解密引擎进行加密处理,并将加密处理后将报文发送至芯片端口的出方向。本发明数据加解密方法减轻了CPU负荷,降低了报文的转发时延。
  • 一种基于soc芯片数据解密方法装置
  • [发明专利]一种加解密数据处理方法及装置-CN202211695362.8在审
  • 贾复山;龚海东;孙文瀚 - 苏州盛科通信股份有限公司
  • 2022-12-28 - 2023-03-28 - G06F21/60
  • 本申请提出一种加解密数据处理方法及装置,通过DMA控制器读取DDR存储器中的TX描述符,并根据TX描述符从DDR存储器读取待加解密报文与加解密参数;将待加解密报文与加解密参数发送至安全引擎单元进行加解密处理;进而根据TX描述符转化确定RX描述符;根据RX描述符将加解密后的报文发送至DDR存储器对应位置;由于待加解密报文、加解密参数与TX描述符存储于DDR存储器26,无需独立的参数管理器对加解密参数进行维护。并且由于可以通过TX描述符转化确定RX描述符,避免CPU针对Tx/Rx方向的描述符单独配置,降低CPU负担,提高处理效率。
  • 一种解密数据处理方法装置
  • [发明专利]双主机协同工作装置-CN201910188623.9有效
  • 贾复山;姜瑞;张继存 - 苏州盛科通信股份有限公司
  • 2019-03-13 - 2023-03-10 - G06F13/16
  • 一种双主机协同工作装置,包括:存储单元,对应不同CPU划分为对应的存储区域;时钟发生器,用于产生当前时间信息;协同控制单元,接收来自不同CPU的访问控制指令,并将所述控制命令或所述交互信息附加当前时间信息后存储到对应的存储区域中;以及,解析所述存储区域中的访问控制指令,将对CPU的访问控制指令存储到与目的CPU对应的存储空间,以及将对从机设备的访问控制指令发送到从机设备的处理模块。通过所述双主机协同工作装置,可以能够达到高效处理内外CPU协同工的双主机协同。
  • 主机协同工作装置

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