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[发明专利]串行接收机及其模拟前端-CN202210097864.4在审
发明人： 舒芋钧 -专利权人：高澈科技（上海）有限公司
申请日： 2022-01-27 - 公布日： 2022-05-03 - 主分类号： G06F13/40 文献下载
摘要：本发明公开了一种串行接收机及其模拟前端，模拟前端包括依次连接的均衡器、驱动器以及模数转换器。驱动器中的量化电路用于对输入的差分信号进行量化处理，控制单元用于根据量化结果控制切换开关的另一端连接至与量化结果对应的参考电平；残差放大器用于对输入的差分信号与电容的另一端接入参考电平的差值进行放大处理；模数转换器用于对放大后的信号进行采样。本发明通过在均衡器和模数转换器之间设置开关阵列和量化单元实现了前级量化，结合模数转换器的后级量化可以实现两步式量化，通过在前级量化和后级量化之间设置残差放大器，可以实现对残差信号的放大，从而可以降低均衡器输出摆幅的要求，同时满足后级模数转换器输入摆幅要求高的需求。
串行接收机及其模拟前端

[发明专利]相位插值电路、锁相环、芯片及电子设备-CN202210079668.4在审
发明人： 舒芋钧 -专利权人：高澈科技（上海）有限公司
申请日： 2022-01-24 - 公布日： 2022-04-29 - 主分类号： H03M3/00 文献下载
摘要：本发明公开了一种相位插值电路、锁相环、芯片及电子设备，其中，相位插值电路包括相位插值器、整数分频器、控制器、第一时钟触发器、数据选择器、第二时钟触发器以及合并单元，相位插值器用于对振荡时钟信号进行相位插值处理；控制器用于对频率控制字的小数部分进行量化处理，根据最终量化结果输出选通信号；整数分频器用于生成第一分频时钟信号；第一时钟触发器用于输出第二分频时钟信号；数据选择器用于输出第一或者第二分频时钟信号；合并单元用于将第二时钟触发器输出的相位插值信号进行等权重合并，输出反馈时钟信号。本发明可以保证输出插值相位的线性，不受相位插值器误差的影响，从而可以降低锁相环的量化噪声，改善前馈通路的线性度。
相位电路锁相环芯片电子设备