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[发明专利]异步处理器架构-CN201980055999.0在审
发明人：克哈莱德·玛来吉;特朗格-邓格·恩古延;朱利恩·斯奇米特;皮埃尔-伊曼纽尔·伯纳德 -专利权人：弗索拉公司
申请日： 2019-05-21 - 公布日： 2021-04-09 - 主分类号： G06F15/80 文献下载
摘要：数据处理方法，其包括：‑控制单元、至少一个ALU(9)、寄存器(11)的集合、存储器(13)和存储器接口(15)。所述方法包括：a)获得(101、102)操作数的存储器地址；b)从存储器(13)读取(103、104)操作数；c)在无任何寻址指令的情况下将执行计算操作的指令传输(105)到ALU(9)；d)借助于ALU(9)在输入处从寄存器(11)接收每一个操作数而执行所有基础操作(106)；e)将形成处理操作的结果的数据存储(107)在寄存器(11)上；f)获得(108)用于形成处理操作的结果的每一个数据的存储器地址；g)经由存储器接口(15)，借助于所获得的存储器地址将结果写入(109)到存储器(13)以供存储。
异步处理器架构

[发明专利]处理器存储器存取-CN201980053161.8在审
发明人：克哈莱德·玛来吉;特朗格-邓格·恩古延;朱利恩·斯奇米特;皮埃尔-伊曼纽尔·伯纳德 -专利权人：弗索拉公司
申请日： 2019-05-21 - 公布日： 2021-04-02 - 主分类号： G06F9/30 文献下载
摘要：本发明涉及一种计算装置，其包括：多个ALU(9)；一组寄存器(11)；存储器(13)；存储器接口，其在所述寄存器(11)和所述存储器(13)之间；控制单元(5)，其通过生成以下各项来控制所述ALU(9)：至少一个循环i，其包含借助于算术逻辑单元(9)实施至少一个第一计算操作和从所述存储器(13)将第一数据集(AA4_7；BB4_7)下载到至少一个寄存器(11)；以及至少一个循环ii，其在所述至少一个循环i之后，包含借助于算术逻辑单元(9)实施第二计算操作，针对所述第二计算操作，所述第一数据集(AA4_7；BB4_7)的至少一部分(A4；B4)形成至少一个操作数。
处理器存储器存取