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- [发明专利]一种多时钟无毛刺切换电路及切换方法-CN202210528780.1在审
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罗东;李庆凤
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无锡华大国奇科技有限公司
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2022-05-16
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2022-10-25
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H03K5/1252
- 本申请公开一种多时钟无毛刺切换电路及切换方法,涉及集成电路领域,电路包括独热译码器、n组时钟选通电路及一个或门;n组时钟选通电路分别接入有n组不同频率和/或相位的时钟源;独热译码器的n个信号输出端分别连接n组时钟选通电路;时钟选通电路用于根据独热译码器输入的独热码进行逻辑运算,确定输出时钟源;n组时钟选通电路的输出端连接到或门的n个输入端,或门的输出端输出选中目标时钟源的时钟信号。本方案通过独热译码器输出独热码选中时钟选通电路,配合同步器反馈的同步信号开启门控时钟单元。切换时钟时保证原先选中的时钟先被关闭,目标时钟后被打开,两者在时间上无重叠,保证输出时钟信号无毛刺。
- 一种多时毛刺切换电路方法
- [发明专利]一种拆机数据保护方法-CN202210610370.1在审
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罗东;李庆凤;陈峰
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无锡华大国奇科技有限公司
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2022-05-31
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2022-08-19
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G06F21/78
- 本申请公开一种拆机数据保护方法,涉及数据传输领域,用于拆机检测芯片,包括:采集第一管脚的第一电平信号值,当第一电平信号值为高电平时,写入第一检测标志位;通过第二管脚采集延时回路的延时信号序列,并与第三管脚发出的原始信号序列进行对比,根据信号值和信号偏移差写入第二检测标志位;基于第一标志位和第二标志位向CPU发送数据销毁请求,以便CPU基于响应数据销毁请求销毁数据。本方案通过拆机检测模块检测设备机体的外壳接触点和引线构成回路的通断以及信号序列之间的信号值和信号偏移差来决定是否写入检测标志位和检测时间,基于两个检测时间的时间差判断是否存在拆机行为,便于CPU确定和执行数据销毁指令。
- 一种数据保护方法
- [发明专利]一种芯片安全启动方法-CN202210589501.2在审
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罗东;陈峰;李庆凤
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无锡华大国奇科技有限公司
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2022-05-26
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2022-07-29
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G06F21/57
- 本申请公开一种芯片安全启动方法,将软件镜像的启动密钥写入到OTPMemory的目标存储区域中,并设置OTP controller关闭访问目标存储区域的第一控制指令;CPU读取Boot ROM中的只读程序,根据其中的操作指令从OTPMemory中读取启动密钥;获取到目标存储区域中的启动密钥后,CPU基于第一控制指令控制OTP controller关闭对目标存储区域的访问权限;CPU基于只读程序和启动密钥解密软件镜像后,跳转到解密后的软件镜像中启动软件镜像。通过将启动密钥放到OTP Memory中,以及OTP controller控制对目标存储区域的访问权限,可以确保芯片软件镜像在存储和运行过程中的安全性。
- 一种芯片安全启动方法
- [发明专利]一种基于MD5的加密方法及系统-CN201910027132.6有效
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曹富强
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无锡华大国奇科技有限公司
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2019-01-11
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2021-12-31
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H04L9/06
- 本发明提供了一种基于MD5的加密方法及系统,所述方法包括以下步骤:S1,获取随机数网络、待加密数据和随机数种子;S2,从所述随机数种子中获取随机数,依据所述随机数和随机数网络,生成二进制数据;S3,对所述待加密数据进行一个轮次的MD5运算,生成所述轮次对应的中间数;S4,利用所述二进制数据对所述中间数进行按位异或运算,生成第二中间数;S5,利用所述第二中间数和所述待加密数据,进行下一个轮次的MD5运算,生成第三中间数;S6,利用所述第三中间数依次重复执行步骤S4和S5,直至MD5运算的轮次个数达到预设轮次,得到加密数据;所述方法解决了现有技术中开源加密算法容易被破解的问题,满足高安全性要求的业务需求。
- 一种基于md5加密方法系统
- [实用新型]一种时钟网络结构-CN202023074546.1有效
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张陈兰;黄平;何梓明;杨洋;陈宏
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无锡华大国奇科技有限公司
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2020-12-18
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2021-07-20
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G06F30/396
- 本实用新型公开一种时钟网络结构,其包括分频电路、时钟树和若干个倍频电路,其中时钟树分别与分频电路和各倍频电路相连;所述分频电路,用于接收来自时钟源的初始时钟信号,并对所述初始时钟信号进行分频,将所得分频信号发送至时钟树;所述倍频电路,用于接收时钟树输出的输出信号,并对所述输出信号进行倍频,输出倍频信号,所述倍频信号与所述初始时钟信号的频率一致。本实用新型通过分频电路降低时钟树的时钟源头的时钟频率,从而降低整个时钟树工作的时钟频率,有效减少时钟树的功耗;然后再通过在时钟树分枝末端添加倍频电路,从而还原时钟频率,保证本实用新型中时钟网络结构所在的芯片的正常工作。
- 一种时钟网络结构
- [实用新型]一种芯片的可测试性架构-CN202022636637.3有效
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张陈兰;黄平;何梓明;杨洋;陈宏
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无锡华大国奇科技有限公司
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2020-11-13
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2021-07-20
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G06F11/22
- 本实用新型公开了一种芯片的可测试性架构,涉及集成电路技术领域。本实用新型所提供的可测试性架构包括测试逻辑模块和功能逻辑模块,所述测试逻辑模块包括独立测试单元和混合测试单元,所述独立测试单元和所述功能逻辑模块相互分离;所述可测试性架构具有功能模式和测试模式,在所述功能模式下,所述独立测试单元的供电被断开;在测试模式下,所述独立测试单元、所述混合测试单元、所述功能逻辑模块的供电处于接通状态。本实用新型在使用时钟门控降低可测试设计芯片动态功耗的基础上,通过多电源域的方法,对测试逻辑模块断电,达到大幅度减少静态功耗的目的,使得芯片的工作时的总体功耗更低。
- 一种芯片测试架构
- [发明专利]一种芯片的可测试性架构-CN202011271586.7在审
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张陈兰;黄平;何梓明;杨洋;陈宏
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无锡华大国奇科技有限公司
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2020-11-13
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2021-01-26
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G06F11/22
- 本发明公开了一种芯片的可测试性架构,涉及集成电路技术领域。本发明所提供的可测试性架构包括测试逻辑模块和功能逻辑模块,所述测试逻辑模块包括独立测试单元和混合测试单元,所述独立测试单元和所述功能逻辑模块相互分离;所述可测试性架构具有功能模式和测试模式,在所述功能模式下,所述独立测试单元的供电被断开;在测试模式下,所述独立测试单元、所述混合测试单元、所述功能逻辑模块的供电处于接通状态。本发明在使用时钟门控降低可测试设计芯片动态功耗的基础上,通过多电源域的方法,对测试逻辑模块断电,达到大幅度减少静态功耗的目的,使得芯片的工作时的总体功耗更低。
- 一种芯片测试架构
- [发明专利]弹性先进先出存储器及存储方法-CN201410491938.8有效
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曹富强
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无锡华大国奇科技有限公司
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2014-09-23
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2018-05-22
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G06F5/06
- 本发明公开了一种弹性先进先出存储器及存储方法,应用于USB3.0中,该存储器采用主控制器开启或者关闭读控制器和写控制器,采用写控制器控制写计数器进行计数,为存储体提供数据的写地址,并将外部输入的数据写入存储体,采用读控制器控制读计数器进行计数,为存储体提供数据的读地址,并输出存储体中的数据,采用同步电路获取写计数器和读计数器的地址值,并将地址值传送给写控制器和读控制器,以进行比较,同时,采用基于地址的握手逻辑来同步写控制器和读控制器的状态信号,从而克服了现有技术中跨时钟域数据传输不稳定的问题,进而使得跨时钟域数据传输更加可靠和稳定。
- 弹性先进存储器存储方法
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