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- [发明专利]应变测量电路-CN202080056340.X在审
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弗里德里希·巴恩米勒;奥利弗·赫特纳;弗兰克·莱姆克;格奥尔格·耶德豪泽
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希奥检测有限公司
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2020-07-20
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2022-03-18
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G01L3/04
- 一种应变测量电路(10)包括布置在衬底(30)上的多个延迟元件(110a、…、110n)的至少第一延迟链(110)和多个延迟元件(210a、…、210n)的至少第二延迟链(210)。至少一个第一和第二延迟链(110、210)的各个延迟元件(110a、…、110n；220a、…、220n)的传播延迟时间取决于施加到衬底(30)的应变。至少一个第一延迟链(110)的延迟元件(110a、…、110n)具有与至少一个第二延迟链(210)的延迟元件(210a、…、210n)不同的取向。电路(10)还包括处理电路(900)，用于根据第一延迟链(110)和第二延迟链(210)的第一信号传播延迟时间来确定施加在衬底(30)上的应变的大小。
- 应变测量电路
- [发明专利]校准时间数字转换器系统的方法及时间数字转换器系统-CN201780084662.3有效
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克里斯蒂安·莫特娜;克里·格洛弗;弗里德里希·巴恩米勒
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希奥检测有限公司
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2017-12-08
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2021-04-06
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G04F10/00
- 本发明实施例提供了一种时间‑数字转换器系统，该系统具有至少一个时间‑数字转换器，该时间‑数字转换器包括：振荡器(RO、RO1、RO2)，尤其是环形振荡器；计数器，由振荡器驱动；评估块，连接至计数器并且被配置为确定与开始信号和停止信号相关的时间差；以及直方图块(HIST、HIST1、HIST2)，具有多个区间，用于记录与时间差相关的条目。该系统能够通过利用测量时钟信号(MCLK)来操作或准备操作时间‑数字转换器系统被校准，该测量时钟信号(MCLK)定义测量间隔(TM)，提供校准时钟信号(CCLK)，其频率以预定比率高于测量时钟信号(MCLK)，将校准时钟信号(CCLK)的选定时钟沿(ph0)用作开始信号(STRT)，并且将校准时钟信号(CCLK)的后续时钟沿(ph1、ph2)用作停止信号(STP1、STP2)。评估块根据被用作开始信号(STRT)和停止信号(STP1、STP2)的校准时钟信号的相应时钟沿(ph0、ph1、ph2)，确定校准时间差。根据预定比率和校准时间差，确定与计数器的计数器步长相关联的时间测量。
- 校准时间数字转换器系统方法
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