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[发明专利]具有条件指令的微处理器及其处理方法-CN201711069237.5有效
发明人： G.葛兰.亨利;泰瑞.派克斯;罗德尼.E.虎克 -专利权人：威盛电子股份有限公司
申请日： 2012-04-09 - 公布日： 2020-06-12 - 主分类号： G06F9/30 文献下载
摘要：一种具有一指令集架构的微处理器。该指令集架构是定义有一指令，其包含一立即字段，其具有一第一部分指定一第一数值与一第二部分指定一第二数值，该指令指示该微处理器执行操作将一固定数值作为其中之一的来源操作数，该固定数值是将第一数值基于第二数值转动/移动一定数量的位而获得。该微处理器包含：指令转译器，将指令转译为至少一立即ALU微指令，其中立即ALU微指令是以不同于指令集架构所定义的指令编码方式进行编码；以及执行管线，执行由指令转译器所产生的微指令，以产生由指令集架构定义的结果。其中指令转译器而非该执行管线，依据第一数值与第二数值产生固定数值作为给立即ALU微指令的一来源操作数，供该执行管线执行。
具有条件指令微处理器及其处理方法

[发明专利]相互节流的通信预取器-CN201510278099.6有效
发明人： 罗德尼.E.虎克;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2015-05-27 - 公布日： 2019-09-17 - 主分类号： G06F12/0862 文献下载
摘要：本发明涉及一种相互节流的通信预取器。一种微处理器包括根据第一算法将数据预取到微处理器的第一硬件数据预取器。该微处理器还包括根据第二算法将数据预取到微处理器的第二硬件数据预取器，其中第一算法与第二算法不同。第二预取器检测到其正在以超过第一预定速率的速率根据第二算法将数据预取到微处理器，并且作为响应，向第一预取器发送节流指示。第一预取器响应于从第二预取器接收到节流指示而以低于第二预定速率的速率根据第一算法将数据预取到微处理器。
相互节流通信预取器

[发明专利]一种微处理器及在其中检测arb的模式的方法-CN201480070694.4有效
发明人： 罗德尼.E.虎克;道格拉斯.R.瑞德 -专利权人：上海兆芯集成电路有限公司
申请日： 2014-12-13 - 公布日： 2019-06-04 - 主分类号： G06F9/46 文献下载
摘要：一种微处理器，包括：高速缓冲，包括标签阵列；标签管线，其仲裁对标签阵列的存取；以及模式检测器。模式检测器包括：快照捕捉逻辑，其捕捉标签管arb的快照——包括关于标签管arb是加载、监听、存储还是其它arb类型以及标签管arb是完成还是重新执行的信息——以及多个可配置的寄存器模块，其可操作来存储用户配置的快照模式。配置逻辑使得用户能够为每个可配置寄存器模块指定用于模式检测器检测的标签管arb的属性，以及配置寄存器模块之间的从属关系。如果标签管arb或者标签管arb的模式满足用户为寄存器模块指定的属性，并且如果寄存器模块从属于的任何其它寄存器模块也处于触发状态，则寄存器模块变为触发。
用于检测暂停逻辑分析器

[发明专利]用于检测暂停的逻辑分析器-CN201480070698.2有效
发明人： 罗德尼.E.虎克;道格拉斯.R.瑞德 -专利权人：上海兆芯集成电路有限公司
申请日： 2014-12-13 - 公布日： 2019-06-04 - 主分类号： G06F12/00 文献下载
摘要：一种微处理器，包括：高速缓冲，包括标签阵列；标签管线，其仲裁对标签阵列的存取；以及模式检测器。模式检测器包括：寄存器；解码器，其解码通过标签管线的标签管arb的传输类型标识符；以及累加器，其将通过标签管线的多个标签管arb的传输类型标识符累加到寄存器中。
用于检测暂停逻辑分析器

[发明专利]微处理器、用于预取数据的方法及非暂态计算机用介质-CN201610514143.3有效
发明人： 罗德尼.E.虎克;柯林.艾迪 -专利权人：威盛电子股份有限公司
申请日： 2016-07-01 - 公布日： 2019-05-31 - 主分类号： G06F12/0862 文献下载
摘要：选择性预取物理接续快取线至包含被载入分页表的快取线。本发明提供一种微处理器，包括一转译查询缓冲器、第一要求、硬件逻辑以及第二要求。第一要求载入一分页表项目至微处理器，以响应未在转译查询缓冲器找到一虚拟地址，被要求的分页表项目被包含于一分页表，分页表包括多个快取线，该等快取线包括一第一快取线，第一快取线包括被要求的分页表项目。硬件逻辑决定物理接续第一快取线的一第二快取线是否在分页表之外。第二要求预取第二快取线至微处理器，第二要求至少基于硬件逻辑所作的决定而被选择性产生。
选择性物理接续快取线至包含载入分页快取线

[发明专利]预取单元和数据预取方法-CN201510494634.1有效
发明人： 罗德尼.E.虎克;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2011-03-29 - 公布日： 2018-11-27 - 主分类号： G06F12/0862 文献下载
摘要：一种预取单元，设置于一微处理器中，包括多个周期匹配计数器以及一控制逻辑。周期匹配计数器分别相应于不同的多个样态周期。控制逻辑用以响应于微处理器存取一存储器区块的动作，更新周期匹配计数器；根据周期匹配计数器的计数值，决定一明显的样态周期；以及根据由周期匹配计数器所决定的具有明显的样态周期的一样态，对存储器区块中的多个快取线中尚未被预取的快取线进行预取。
单元数据方法

[发明专利]用于检测暂停的逻辑分析器-CN201480070655.4有效
发明人： 罗德尼.E.虎克;道格拉斯.R.瑞德 -专利权人：上海兆芯集成电路有限公司
申请日： 2014-12-13 - 公布日： 2018-11-20 - 主分类号： G06F9/30 文献下载
摘要：一种微处理器，包括：高速缓冲，包括标签阵列；标签管，其仲裁标签阵列的存取；以及逻辑分析器，用于调查不足、活锁或死锁状况。包括耦接到标签管的读取逻辑的逻辑分析器被配置为记录存取标签阵列的传输的快照。
用于检测暂停逻辑分析器

[发明专利]数据预取方法以及微处理器-CN201510101351.6有效
发明人： 罗德尼.E.虎克;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2011-03-29 - 公布日： 2018-08-31 - 主分类号： G06F9/38 文献下载
摘要：一种数据预取方法以及微处理器。该微处理器包括：一第一级快取存储器；一第二级快取存储器；以及一预取单元，用以：检测出现在上述第二级快取存储器中的最近存取要求的一方向以及样态，以及根据上述方向以及样态，将多个快取线预取至上述第二级快取存储器中；从上述第一级快取存储器，接收上述第一级快取存储器所接收的一存取要求的一地址，其中上述地址与一快取线相关；决定在上述方向中所相关的快取线之后被上述样态所指出的一个或多个快取线；以及导致上述一个或多个快取线被预取至上述第一级快取存储器中。
数据方法以及微处理器

[发明专利]用于微处理器的动态重设方法-CN201410768028.X有效
发明人： G.G.亨利;罗德尼.E.虎克;柯林.艾迪;泰瑞.派克斯 -专利权人：上海兆芯集成电路有限公司
申请日： 2014-09-19 - 公布日： 2018-04-13 - 主分类号： G06F9/30 文献下载
摘要：本发明提供一种用于微处理器的动态重设方法，该微处理器至少包括指纹单元及动态重设功能单元，该方法包括接受静态指纹以及指纹产生准则的指纹设定准则表，其中该静态指纹用于优化该微处理器的该动态重设功能单元的配置，其中该静态指纹由工程师辨识用于优化该动态重设功能单元的该配置的程序部分、依据与该程序部分有关的指令串设计该指纹产生准则、并利用该指纹产生准则所产生；当该动态重设功能单元正依据目前配置设定而执行指令时，该指纹单元产生动态指纹并与该静态指纹进行比较；以及当该静态指纹与该动态指纹相符时，重设该动态重设功能单元。
用于微处理器动态重设方法

[发明专利]用于微处理器的动态重设方法-CN201410766866.3有效
发明人： G.G.亨利;罗德尼.E.虎克;柯林.艾迪;泰瑞.派克斯 -专利权人：上海兆芯集成电路有限公司
申请日： 2014-09-19 - 公布日： 2018-04-13 - 主分类号： G06F9/30 文献下载
摘要：一种用于微处理器的动态重设方法，该微处理器至少包括指纹单元及动态重设功能单元，该方法包括接受静态指纹以及指纹产生准则的指纹设定准则表，其中该静态指纹用于优化该微处理器的该动态重设功能单元的配置；当该动态重设功能单元正依据目前配置设定而执行指令时，该指纹单元产生动态指纹并与该静态指纹进行比较；以及当该静态指纹与该动态指纹相符时，重设该动态重设功能单元。
用于微处理器动态重设方法

[发明专利]操作微处理器的方法-CN201510115612.X有效
发明人： G.葛兰.亨利;泰瑞.派克斯;罗德尼.E.虎克 -专利权人：威盛电子股份有限公司
申请日： 2012-04-09 - 公布日： 2018-04-06 - 主分类号： G06F9/30 文献下载
摘要：一种操作微处理器的方法，包括检测已经发送信号以重置一微处理器，其中由微处理器执行所述检测步骤；响应于所述检测已经发送信号以重置微处理器，确定x86ISA和ARM ISA中的哪一个被微处理器的一指标指示为微处理器的启动ISA，其中由微处理器执行所述确定步骤；初始化由启动ISA定义的微处理器的一架构状态，其中由微处理器执行所述初始化步骤；将在重置之后由微处理器从架构存储空间撷取的初始ISA指令转译为微指令以作为启动ISA的指令，其中由微处理器的一硬件指令转译器执行所述转译步骤；以及执行所述微指令以产生由启动ISA定义的结果，其中由耦接到硬件指令转译器的微处理器的一执行管线执行所述执行步骤，其中该指标包括微处理器的微编码中的预设值。
操作微处理器方法

[发明专利]具有条件指令的微处理器及其处理方法-CN201610008424.1有效
发明人： G.葛兰.亨利;吉拉德.M.卡尔;罗德尼.E.虎克;泰瑞.派克斯 -专利权人：威盛电子股份有限公司
申请日： 2012-04-09 - 公布日： 2018-04-06 - 主分类号： G06F9/30 文献下载
摘要：微处理器执行一架构指令指示其去执行一操作于第一与第二来源操作数以产生一结果，并在其架构条件旗标满足架构指令所预设的条件时，将此结果写入一目的寄存器。硬件指令转译器将此指令转译为第一与第二微指令。就第一微指令而言，执行管线执行操作于来源操作数以产生此结果。就第二微指令而言，执行管线在架构条件旗标满足条件，将第一微指令所产生的结果写入目的寄存器，而在架构条件旗标不满足条件时，将目的寄存器当前的数值写入目的寄存器。
具有条件指令微处理器及其处理方法

[发明专利]具有条件指令的微处理器及其处理方法-CN201610126292.2有效
发明人： G.葛兰.亨利;泰瑞.派克斯;罗德尼.E.虎克 -专利权人：威盛电子股份有限公司
申请日： 2012-04-09 - 公布日： 2018-02-16 - 主分类号： G06F9/30 文献下载
摘要：一个执行条件非分支指令的微处理器。该微处理器包含一预测器，用以提供关于一条件非分支指令的预测；一指令转译器，用以在该预测预测该条件将不会被满足时，将该条件非分支指令转译为具有条件码的一不操作微指令，其中具有条件码的不操作微指令除了使执行单元启动来检查该预测外不会执行其它操作；以及在该预测预测该条件将会被满足时，将该条件非分支指令转译为单个具有条件码的可操作微指令以非条件地执行该操作；一执行管线，包括指令发布单元和多个执行单元，其中指令发布单元操作来发布该单个具有条件码的可操作微指令给多个执行单元的选择的一个，并且所选择的执行单元操作来执行该单个具有条件码的可操作微指令。
具有条件指令微处理器及其处理方法

[发明专利]数据预取方法以及微处理器-CN201510101303.7有效
发明人： 罗德尼.E.虎克;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2011-03-29 - 公布日： 2018-01-26 - 主分类号： G06F12/0862 文献下载
摘要：一种数据预取方法以及微处理器。该微处理器包括一快取存储器；以及一预取单元，用以检测具有一第一存储器区块的多个存储器存取要求的一样态，并且根据上述样态从上述第一存储器区块预取多个快取线至上述快取存储器中；监视一第二存储器区块的一新的存储器存取要求；决定上述第一存储器区块是否虚拟邻近于上述第二存储器区块，并且当自上述第一存储器区块延续至上述第二存储器区块时，则决定上述样态是否预测到上述第二存储器区块的新的存储器存取要求所相关的一快取线在上述第二存储器区块中；以及根据上述样态，响应地从上述第二存储器区块将上述快取线预取至上述快取存储器中。
数据方法以及微处理器

[发明专利]控制寄存器对应于异质指令集架构处理器-CN201510074079.7有效
发明人： G.葛兰.亨利;泰瑞.派克斯;罗德尼.E.虎克 -专利权人：威盛电子股份有限公司
申请日： 2012-04-09 - 公布日： 2017-12-01 - 主分类号： G06F9/30 文献下载
摘要：一种可执行x86指令集架构(ISA)机器语言程序以及高级精简指令集机器(ARM)ISA机器语言程序的微处理器。该微处理器包含一指令模式，指示该微处理器撷取一x86 ISA或一ARM ISA机器语言程序指令；以及复数个硬件寄存器，其中，当该指令模式指示该微处理器撷取x86 ISA机器语言程序指令时，该些硬件寄存器储存x86 ISA架构状态，其中，当该指令模式指示该微处理器撷取ARM ISA机器语言程序指令时，该些硬件寄存器储存ARM ISA架构状态。
控制寄存器对应指令架构处理器

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