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[发明专利]数字电路的连接方法、装置、电子设备和存储介质-CN202110724897.2有效
发明人： 王万丰;汪波 -专利权人：海光信息技术股份有限公司
申请日： 2021-06-29 - 公布日： 2023-08-04 - 主分类号： G06F30/33 文献下载
摘要：一种数字电路的连接方法、装置、电子设备及存储介质。该数字电路的连接方法包括：确定每个路径终点对应的至少一条关键路径；基于至少一条关键路径，确定第一逻辑器件集合；基于多条电路路径和第一逻辑器件集合，确定每个路径终点对应的第二逻辑器件集合和第三逻辑器件集合；对第二逻辑器件集合进行克隆处理，以得到第二逻辑器件集合对应的克隆器件集合；基于多条电路路径，对第三逻辑器件集合及克隆器件集合中的逻辑器件进行连接处理，以得到每个路径终点对应的至少一条连接路径。该数字电路的连接方法可以对路径起点和路径终点之间的电路进行有效连接和克隆，从而解决由于多个路径终点对应于同一个路径起点而造成的难以优化时序的问题。
数字电路连接方法装置电子设备存储介质

[发明专利]数据链路的提取方法、装置、电子设备和存储介质-CN202110724291.9有效
发明人： 王万丰;郭杰辰 -专利权人：海光信息技术股份有限公司
申请日： 2021-06-29 - 公布日： 2023-06-30 - 主分类号： G06F30/3315 文献下载
摘要：一种数据链路的提取方法、装置、电子设备和存储介质。该数据链路的提取方法包括：从多个器件和多个端口中选择待分析的至少一组数据链路端点；对多个器件和至少一组数据链路端点进行时序处理，以使得数字电路中除至少一组数据链路端点外的其他器件均不具有时序器件特性；基于经过时序处理后的多个器件和至少一组数据链路端点，确定每组数据链路端点对应的所有数据链路。该数据链路的提取方法通过将数字电路中除至少一组数据链路端点外的其他器件设置为不具有时序器件特性的组合逻辑器件，获得数字电路中的所有数据链路，以用于电路优化、电路时序评估等其他处理。
数据链提取方法装置电子设备存储介质

[发明专利]集成电路设计方法、装置、电子设备和可读存储介质-CN202110724884.5有效
发明人：汪波;王万丰 -专利权人：海光信息技术股份有限公司
申请日： 2021-06-29 - 公布日： 2023-06-06 - 主分类号： G06F30/3312 文献下载
摘要：一种集成电路设计方法、装置、电子设备和计算机可读存储介质。该集成电路设计方法包括：获取多个时序路径中发生时序违反的至少一个目标时序违反路径；确定至少一个目标时序违反路径的逻辑单元集合，逻辑单元集合中的元素为至少一个目标时序违反路径所包含的逻辑单元；计算逻辑单元集合中每个逻辑单元对应的特征距离；基于每个逻辑单元对应的特征距离，从逻辑单元集合中确定目标单元；以及基于目标单元，复制初始集成电路中的至少部分电路逻辑结构而得到克隆电路逻辑结构，以利用克隆电路逻辑结构降低目标时序违反路径的时序违反程度。该方法可以缩短逻辑复制的时间，可以自动对较多的时序违反路径进行处理，从而提高了实现时序收敛的效率。
集成电路设计方法装置电子设备可读存储介质

[发明专利]差异化收费策略效果预测方法、装置、设备及存储介质-CN202210160682.7在审
发明人：薛敏;陈全;张龑;潘成贵;王万丰;彭伟;王文浅;秦成;谢海强;朱贺明 -专利权人：西藏招商交建电子信息有限公司;广西桂兴高速公路投资建设有限公司
申请日： 2022-02-22 - 公布日： 2022-05-27 - 主分类号： G06Q10/04 文献下载
摘要：本发明公开了一种差异化收费策略效果预测方法、装置、设备及存储介质。该方法包括：对目标路段的目标用户进行分类，得到至少一组类型用户；获取至少一种候选策略，利用训练好的目标参与预测模型确定各所述类型用户在目标时间段内针对不同候选策略的预测参与概率及预测参与程度；根据各所述类型用户在不同候选策略下的预测参与概率及预测参与程度，确定各所述候选策略的预测收益。本发明通过对目标路段的高速用户进行分类，针对性的预测不同类型用户对于不同收费策略的参与度，从而准确预测各种收费策略整体的收益效果，以方便选取目标时间段内针对于目标路段的最优收费策略，在用户享受折扣优惠的同时满足收益最大化。
异化收费策略效果预测方法装置设备存储介质

[发明专利]高速数据接口主机端控制器-CN201510894416.7在审
发明人： 王万丰;冀晓亮;惠志强;侯慧瑛 -专利权人：上海兆芯集成电路有限公司
申请日： 2015-12-07 - 公布日： 2016-05-04 - 主分类号： G06F13/38 文献下载
摘要：低数据抖动的主机端控制器，以逻辑物理层提供多组低速数据，经由跨时域数据传输模块交由对应的电子物理层转换为高速数据传递至对应的外部装置，且还具有多工器。所述电子物理层对应多个时钟信号之一操作。该多工器接收所述时钟信号，以输出共同时钟信号供逻辑物理层据以提供所述多组低速数据。该跨时域数据传输模块根据该共同时钟信号读入该逻辑物理层提供的所述多组低速数据，并根据所述外部装置所对应的所述电子物理层对应的所述时钟信号输出所述多组低速数据至对应的所述电子物理层。
高速数据接口主机控制器

[发明专利]高速数据接口主机端控制器-CN201510894510.2在审
发明人： 王万丰;冀晓亮;惠志强;侯慧瑛 -专利权人：上海兆芯集成电路有限公司
申请日： 2015-12-07 - 公布日： 2016-04-20 - 主分类号： G06F13/38 文献下载
摘要：低数据抖动的主机端控制器，以逻辑物理层提供低速数据，经由跨时域数据传输模块交由电子物理层转换为高速数据传递至外部装置。该电子物理层操作用的时钟信号还传递至该逻辑物理层，使该逻辑物理层据以提供所述第一低速数据。该跨时域数据传输模块根据逻辑物理层端时钟读入该逻辑物理层为该外部装置提供的低速数据，并根据电子物理层端时钟输出所述第一低速数据至该电子物理层。
高速数据接口主机控制器

[发明专利]一种视频编码方法和装置-CN201110005106.7有效
发明人：虞露;魏亮;王万丰 -专利权人：浙江大学
申请日： 2011-01-12 - 公布日： 2011-08-03 - 主分类号： H04N7/26 文献下载
摘要：本发明属于数字视频编解码技术领域，特别涉及一种视频编码方法与装置，该方法包含n个流水级（n为整数，），包含视频编码所需模块：原始图像和参考图像存取、整像素运动估计、亚像素运动估计、帧内预测、运动补偿、变换量化、重建环路、环路滤波、熵编码等。其中在流水级安排上，每个流水级不受固定时间片约束，而只依赖于前后处理的数据关系；其次在编码过程中，每个流水级的时间片根据编码参数、编码内容等进行动态调整；并采用适合灵活流水级管理和模块管理的控制方法。本发明针对现有技术的不足，提供了一种灵活的流水级安排策略和视频编码模块分配方法以及流水级管理与模块控制策略，充分利用了流水级（模块）处理数据之间的相关性，提高了编码的吞吐率，适合高清晰度等实时视频编码的实现。
一种视频编码方法装置

[发明专利]视频处理器视频数据与存储器存储空间的映射方法-CN200810062246.6有效
发明人：虞露;王万丰;张珂;朱韵鹏 -专利权人：浙江大学
申请日： 2008-06-10 - 公布日： 2008-11-12 - 主分类号： H04N7/26 文献下载
摘要：本发明属于数字视频编解码技术领域，特别是涉及一种视频处理器视频数据与存储器存储空间的映射方法；包括六个步骤，依据映射关系充分利用带分页结构的存储器不同分页内数据存取的并发性等特点，将视频图像的亮度分量和色度分量进行划分，并以亮度分组和色度分组的方式映射到存储器相应的页地址、行地址和列地址内，使得视频处理器对视频数据的访问带宽很大程度上得以提高；规定了进入存储器的视频图像在存储器内的存储、替代与更新过程，从而保证了视频处理器的正常工作。
视频处理器数据存储器存储空间映射方法

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