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[发明专利]具有密码引擎的无线电发射器设备-CN202180020008.2在审
发明人：马尔科·温布拉德;汉努·塔尔维蒂 -专利权人：北欧半导体公司
申请日： 2021-03-09 - 公布日： 2022-10-25 - 主分类号： H04L9/00 文献下载
摘要：一种集成电路无线电发射器芯片(2)包含发射器(7)、密码引擎(12)和用于所述密码引擎的控制电路系统(13)。所述密码引擎(12)通过接收输入数据、执行生成第一结果数据的第一过程和生成第二结果数据的第二过程来执行密码操作。所述第一和第二结果数据用于生成输出数据。响应于确定所述发射器(7)活动，所述控制电路系统(13)控制所述密码引擎(12)执行所述第一过程并防止所述密码引擎在所述发射器活动时执行所述第二过程。响应于确定所述发射器(7)不活动，所述控制电路系统(13)控制所述密码引擎(12)执行所述第二过程。
具有密码引擎无线电发射器设备

[发明专利]软件跟踪消息接收器外围设备-CN201980051540.3在审
发明人： 汉努·塔尔维蒂;乔妮·简妮特伊 -专利权人：北欧半导体公司
申请日： 2019-05-30 - 公布日： 2021-03-19 - 主分类号： G06F11/36 文献下载
摘要：一种集成电路器件(100)，其具有处理器(128)、软件跟踪消息处理系统(110)、软件跟踪消息接收器外围设备(122)和硬件互连系统(132)。互连系统(132)能够将软件跟踪消息从所述处理器(128)导向所述软件跟踪消息处理系统(110)，并且能够将软件跟踪消息从所述处理器(128)导向所述软件跟踪消息接收器外围设备(122)。当从所述处理器(128)接收到软件跟踪消息时，所述软件跟踪消息接收器外围设备(122)可向所述处理器(128)呈现互连延迟，所述互连延迟等于或基本上等于如果所述软件跟踪消息处理系统(110)已接收到所述软件跟踪消息，则所述软件跟踪消息处理系统(110)将会向所述处理器(128)呈现的互连延迟。
软件跟踪消息接收器外围设备

[发明专利]存储器高效的硬件加密引擎-CN201980049863.9在审
发明人：马可·温布拉德;马克库·瓦哈泰尼;詹姆斯·尼瓦拉;马蒂·蒂凯宁;汉努·塔尔维蒂 -专利权人：北欧半导体公司
申请日： 2019-05-29 - 公布日： 2021-03-16 - 主分类号： G06F21/72 文献下载
摘要：一种硬件加密引擎(8)包括用于通过存储器总线接收输入数据的直接存储器存取(DMA)输入模块(13)，及加密模块(15)。所述加密模块(15)包括具有输入寄存器长度的输入寄存器(20)，及配置成对所述输入寄存器(20)中的数据执行加密操作的电路系统(22)。所述硬件加密引擎(8)还包括长度小于所述输入寄存器长度的两倍的输入对齐缓冲器(16)，及用于对所述输入对齐缓冲器(16)中的输入数据执行对齐操作的对齐电路系统(23)。所述硬件加密引擎(8)配置成在缓冲不大于所述输入对齐缓冲器(16)的所述长度的输入数据量之后，将由所述DMA输入模块(13)所接收的输入数据从所述存储器总线(10)传送到所述加密模块(15)的所述输入寄存器(20)。
存储器高效硬件加密引擎

[发明专利]直接存储器存取控制器-CN201980048615.2在审
发明人：马可·温布拉德;马克库·瓦哈泰尼;詹姆斯·尼瓦拉;马蒂·蒂凯宁;汉努·塔尔维蒂 -专利权人：北欧半导体公司
申请日： 2019-05-28 - 公布日： 2021-03-09 - 主分类号： G06F13/28 文献下载
摘要：电子设备(1)具有处理器(2)；外围设备(3)，所述外围设备具有数据接口和数据属性接口；用于所述外围设备(3)的直接存储器存取(DMA)控制器(6；7)；存储器(4)；总线系统(5)，所述总线系统连接所述处理器(2)、所述DMA控制器(6；7)和所述存储器(4)；在所述DMA控制器(6；7)与所述外围设备(3)之间的数据链路(8；10)；以及在所述DMA控制器(6；7)与所述外围设备(3)之间的数据属性链路(9；11)，所述数据属性链路与所述数据链路(8；10)分开。所述DMA控制器(6；7)具有数据传递电路系统，用于通过所述数据链路(8；10)在所述存储器(4)与所述外围设备(3)的所述数据接口之间传递数据，以及用于通过所述数据属性链路(9；11)在所述存储器(4)与所述外围设备(3)的所述数据属性接口之间传递与所述数据相关联的数据属性信息。
直接存储器存取控制器